參數資料
| 型號： | APA075-TQ144 |
| 廠商： | Microsemi SoC |
| 文件頁數： | 148/178頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA PROASIC+ 75K 144-TQFP |
| 標準包裝： | 60 |
| 系列： | ProASICPLUS |
| RAM 位總計： | 27648 |
| 輸入/輸出數： | 107 |
| 門數： | 75000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 144-LQFP |
| 供應商設備封裝： | 144-TQFP（20x20） |
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ProASICPLUS Flash Family FPGAs
v5.9
2-61
Synchronous Write and Read to the Same Location
Note: * New data is read if WCLKS
↑ occurs before setup time. The data stored is read if WCLKS ↑ occurs after hold time. The plot shows
the normal operation status.
Figure 2-34 Synchronous Write and Read to the Same Location
Table 2-58 TJ = 0°C to 110°C; VDD = 2.3 V to 2.7 V for Commercial/Industrial
TJ = –55°C to 150°C, VDD = 2.3 V to 2.7 V for Military/MIL-STD-883
Symbol txxx
Description
Min.
Max.
Units
Notes
CCYC
Cycle time
7.5
ns
CMH
Clock high phase
3.0
ns
CML
Clock low phase
3.0
ns
WCLKRCLKS
WCLKS
↑ to RCLKS ↑ setup time
– 0.1
ns
WCLKRCLKH
WCLKS
↑ to RCLKS ↑ hold time
7.0
ns
OCH
Old DO valid from RCLKS
↑
3.0
ns
OCA/OCH displayed for
Access Timed Output
OCA
New DO valid from RCLKS
↑
7.5
ns
Notes:
1. This behavior is valid for Access Timed Output and Pipelined Mode Output. The table shows the timings of an Access Timed Output.
2. During synchronous write and synchronous read access to the same location, the new write data will be read out if the active write
clock edge occurs before or at the same time as the active read clock edge. The negative setup time insures this behavior for WCLKS
and RCLKS driven by the same design signal.
3. If WCLKS changes after the hold time, the data will be read.
4. A setup or hold time violation will result in unknown output data.
RCLKS
DO
WCLKS
t
WCLKRCLKH
New Data*
Last Cycle Data
t
WCLKRCLKS
t
OCH
t
CCYC
t
CMH
t
CML
t
OCA
相關PDF資料 |
PDF描述 |
|---|---|
| APA075-PQ208 | IC FPGA PROASIC+ 75K 208-PQFP |
| ASC36DRYI-S13 | CONN EDGECARD 72POS .100 EXTEND |
| HSC40DRAI | CONN EDGECARD 80POS R/A .100 SLD |
| GCB80DHBS | CONN EDGECARD 160PS R/A .050 SLD |
| ABM43DRMT-S288 | CONN EDGECARD EXTEND 86POS .156 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| APA075-TQ144I | 功能描述:IC FPGA PROASIC+ 75K 144-TQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:ProASICPLUS 標準包裝:90 系列:ProASIC3 LAB/CLB數:- 邏輯元件/單元數:- RAM 位總計:36864 輸入/輸出數:157 門數:250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應商設備封裝:256-FPBGA（17x17） |
| APA075-TQ896A | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Automotive-Grade ProASIC Flash Family FPGAs |
| APA075-TQB | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-TQES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA075-TQG100 | 功能描述:IC FPGA PROASIC+ 75K 100-TQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:ProASICPLUS 標準包裝:152 系列:IGLOO PLUS LAB/CLB數:- 邏輯元件/單元數:792 RAM 位總計:- 輸入/輸出數:120 門數:30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應商設備封裝:289-CSP（14x14） |
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