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參數(shù)資料
| 型號： | AGLP030V5-CS201I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 64/134頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA IGLOO PLUS 30K 201-CSP |
| 標(biāo)準(zhǔn)包裝： | 384 |
| 系列： | IGLOO PLUS |
| 邏輯元件/單元數(shù)： | 792 |
| 輸入/輸出數(shù)： | 120 |
| 門數(shù)： | 30000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 201-VFBGA，CSBGA |
| 供應(yīng)商設(shè)備封裝： | 201-CSP（8x8） |
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IGLOO PLUS Low Power Flash FPGAs
Revision 16
2-21
Summary of I/O Timing Characteristics – Default I/O Software Settings
Table 2-23 Summary of AC Measuring Points
Standard
Measuring Trip Point (Vtrip)
3.3 V LVTTL / 3.3 V LVCMOS
1.4 V
3.3 V LVCMOS Wide Range
1.4 V
2.5 V LVCMOS
1.2 V
1.8 V LVCMOS
0.90 V
1.5 V LVCMOS
0.75 V
1.2 V LVCMOS
0.60 V
1.2 V LVCMOS Wide Range
0.60 V
Table 2-24 I/O AC Parameter Definitions
Parameter
Parameter Definition
tDP
Data to Pad delay through the Output Buffer
tPY
Pad to Data delay through the Input Buffer
tDOUT
Data to Output Buffer delay through the I/O interface
tEOUT
Enable to Output Buffer Tristate Control delay through the I/O interface
tDIN
Input Buffer to Data delay through the I/O interface
tHZ
Enable to Pad delay through the Output Buffer—High to Z
tZH
Enable to Pad delay through the Output Buffer—Z to High
tLZ
Enable to Pad delay through the Output Buffer—Low to Z
tZL
Enable to Pad delay through the Output Buffer—Z to Low
tZHS
Enable to Pad delay through the Output Buffer with delayed enable—Z to High
tZLS
Enable to Pad delay through the Output Buffer with delayed enable—Z to Low
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AGLP030V5-CSG201I | IC FPGA IGLOO PLUS 30K 201-CSP |
| ACM36DTBS-S189 | CONN EDGECARD 72POS R/A .156 SLD |
| M1AGL250V2-FGG144 | IC FPGA 1KB FLASH 250K 144-FBGA |
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| AYM30DTAS-S189 | CONN EDGECARD 60POS R/A .156 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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