2-18 Revision 17 Figure 2-6 Tristate Output Buffer Timing Model and Delays (example) D CLK Q D" />
參數(shù)資料
型號(hào): AGLN125V5-VQG100
廠商: Microsemi SoC
文件頁數(shù): 79/150頁
文件大?。?/td> 0K
描述: IC FPGA 125K 1.5V 100VTQFP
標(biāo)準(zhǔn)包裝: 90
系列: IGLOO nano
邏輯元件/單元數(shù): 3072
RAM 位總計(jì): 36864
輸入/輸出數(shù): 71
門數(shù): 125000
電源電壓: 1.425 V ~ 1.575 V
安裝類型: 表面貼裝
工作溫度: -20°C ~ 70°C
封裝/外殼: 100-TQFP
供應(yīng)商設(shè)備封裝: 100-VQFP(14x14)
其它名稱: 1100-1132
IGLOO nano DC and Switching Characteristics
2-18
Revision 17
Figure 2-6 Tristate Output Buffer Timing Model and Delays (example)
D
CLK
Q
D
CLK
Q
10% VCCI
tZL
Vtrip
50%
tHZ
90% VCCI
tZH
Vtrip
50%
tLZ
50%
EOUT
PAD
D
E
50%
tEOUT (R)
50%
tEOUT (F)
PAD
DOUT
EOUT
D
I/O Interface
E
tEOUT
tZLS
Vtrip
50%
tZHS
Vtrip
50%
EOUT
PAD
D
E
50%
tEOUT (R)
tEOUT (F)
50%
VCC
VCCI
VCC
VOH
VOL
tZL, tZH, tHZ, tLZ, tZLS, tZHS
tEOUT = MAX(tEOUT(r), tEOUT(f))
相關(guān)PDF資料
PDF描述
4-1624113-4 INDUCTOR 82NH 5% 0805
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參數(shù)描述
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