Revision 17 2-15 User I/O Characteristics Timing Model Figure 2-3 Timing Model Operating" />
參數資料
型號： AGLN125V5-VQG100
廠商： Microsemi SoC
文件頁數： 76/150頁
文件大小： 0K
描述： IC FPGA 125K 1.5V 100VTQFP
標準包裝： 90
系列： IGLOO nano
邏輯元件/單元數： 3072
RAM 位總計： 36864
輸入/輸出數： 71
門數： 125000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -20°C ~ 70°C
封裝/外殼： 100-TQFP
供應商設備封裝： 100-VQFP（14x14）
其它名稱： 1100-1132
IGLOO nano Low Power Flash FPGAs
Revision 17
2-15
User I/O Characteristics
Timing Model
Figure 2-3 Timing Model
Operating Conditions: STD Speed, Commercial Temperature Range (TJ = 70°C), Worst-Case
VCC = 1.425 V, for DC 1.5 V Core Voltage, Applicable to V2 and V5 Devices
DQ
Y
DQ
Y
Combinational Cell
I/O Module
(Registered)
I/O Module
(Non-Registered)
Register Cell
I/O Module
(Registered)
I/O Module
(Non-Registered)
LVCMOS 2.5 V Output Drive
Strength = 8 mA High Slew Rate
Input LVCMOS 2.5 V
LVCMOS 1.5 V
LVTTL 3.3 V Output drive
strength = 8 mA High slew rate
Y
Combinational Cell
Y
Combinational Cell
Y
Combinational Cell
I/O Module
(Non-Registered)
LVTTLOutput drive strength = 8 mA
High slew rate
I/O Module
(Non-Registered)
LVCMOS 1.5 VOutput drive strength = 2 mA
High slew rate
LVTTLOutput drive strength = 4 mA
High slew rate
I/O Module
(Non-Registered)
Input LVTTL
Clock
Input LVTTL
Clock
Input LVTTL
Clock
tPD = 1.18 ns
tPD = 0.90 ns
tDP = 1.99 ns
tPD = 1.60 ns
tDP = 2.35 ns
tPD = 1.17 ns
tDP = 1.96 ns
tPD = 0.87 ns
tDP = 2.65 ns
tPD = 0.91 ns
tPY = 0.85 ns
tCLKQ = 0.89 ns
tOCLKQ = 1.00 ns
tSUD = 0.81 ns
tOSUD = 0.51 ns
tDP = 1.96 ns
tPY = 0.85 ns
tPY = 1.15 ns
tCLKQ = 0.89 ns
tSUD = 0.81 ns
tPY = 0.85 ns
tICLKQ = 0.42 ns
tISUD = 0.47 ns
tPY = 1.06 ns
相關PDF資料
PDF描述
4-1624113-4 INDUCTOR 82NH 5% 0805
ASM24DTAI CONN EDGECARD 48POS R/A .156 SLD
REC3-1215SRW/H4/A CONV DC/DC 3W 9-18VIN 15VOUT
ASM24DTBI CONN EDGECARD 48POS R/A .156 SLD
AIMC-0402-5N6S-T INDUCTOR MULTILAYER 5.6NH 0402
相關代理商/技術參數
參數描述
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