參數(shù)資料
型號(hào)： ADV202BBCZRL-115
廠商： Analog Devices Inc
文件頁數(shù)： 22/40頁
文件大?。?/td> 0K
描述： IC CODEC VIDEO 115MHZ 121CSPBGA
標(biāo)準(zhǔn)包裝： 1,500
類型： JPEG2000 視頻編解碼器
分辨率（位）： 16 b
三角積分調(diào)變： 無
電壓 - 電源，模擬： 1.5V，3.3V
電壓 - 電源，數(shù)字： 1.5V，3.3V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 121-BGA，CSPBGA
供應(yīng)商設(shè)備封裝： 121-CSPBGA（12x12）
包裝： 帶卷 (TR)
ADV202
Rev. D | Page 29 of 40
INTERNAL REGISTERS
This section describes the internal registers of the ADV202.
DIRECT REGISTERS
The ADV202 has 16 direct registers, as listed in Table 19.
The direct registers are accessed over the ADDR[3:0],
HDATA[31:0], CS, RD, WR, and ACK pins.
The host must first initialize the direct registers before any
application-specific operation can be implemented.
For additional information on accessing and configuring these
registers, see the ADV202 User’s Guide.
Table 19. Direct Registers
Address
Name
Description
0x00
PIXEL
Pixel FIFO Access Register
0x01
CODE
Compressed Code Stream Access Register
0x02
ATTR
Attribute FIFO Access Register
0x03
Reserved
0x04
CMDSTA
Command Stack
0x05
EIRQIE
External Interrupt Enabled
0x06
EIRQFLG
External Interrupt Flags
0x07
SWFLAG
Software Flag Register
0x08
BUSMODE
Bus Mode Configuration Register
0x09
MMODE
Miscellaneous Mode Register
0x0A
STAGE
Staging Register
0x0B
IADDR
Indirect Address Register
0x0C
IDATA
Indirect Data Register
0x0D
BOOT
Boot Mode Register
0x0E
PLL_HI
PLL Control Register—High Byte
0x0F
PLL_LO
PLL Control Register—Low Byte
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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ADV202BCZ-150 制造商:Analog Devices 功能描述:JPEG 2000 CODEC CONVERTER, LEAD FREE - Trays
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