tSL SCLOCK Low " />
參數(shù)資料
型號: ADUC834BCPZ
廠商: Analog Devices Inc
文件頁數(shù): 74/80頁
文件大小: 0K
描述: IC MCU 62K FLASH ADC/DAC 56LFCSP
標(biāo)準(zhǔn)包裝: 1
系列: MicroConverter® ADuC8xx
核心處理器: 8052
芯體尺寸: 8-位
速度: 12.58MHz
連通性: EBI/EMI,I²C,SPI,UART/USART
外圍設(shè)備: POR,PSM,PWM,溫度傳感器,WDT
輸入/輸出數(shù): 34
程序存儲器容量: 62KB(62K x 8)
程序存儲器類型: 閃存
EEPROM 大?。?/td> 4K x 8
RAM 容量: 2.25K x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 5.25 V
數(shù)據(jù)轉(zhuǎn)換器: A/D 3x16b,4x24b; D/A 1x12b
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 56-VFQFN 裸露焊盤,CSP
包裝: 托盤
REV. A
–76–
ADuC834
Parameter
Min
Typ
Max
Unit
Figure
SPI MASTER MODE TIMING (CPHA = 0)
tSL
SCLOCK Low Pulsewidth
*
630
ns
76
tSH
SCLOCK High Pulsewidth
*
630
ns
76
tDAV
Data Output Valid after SCLOCK Edge
50
ns
76
tDOSU
Data Output Setup before SCLOCK Edge
150
ns
76
tDSU
Data Input Setup Time before SCLOCK Edge
100
ns
76
tDHD
Data Input Hold Time after SCLOCK Edge
100
ns
76
tDF
Data Output Fall Time
10
25
ns
76
tDR
Data Output Rise Time
10
25
ns
76
tSR
SCLOCK Rise Time
10
25
ns
76
tSF
SCLOCK Fall Time
10
25
ns
76
*Characterized under the following conditions:
a. Core clock divider bits CD2, CD1 and CD0 in PLLCON SFR set to 0, 1, and 1 respectively, i.e., core clock frequency = 1.57 MHz, and
b. SPI bit-rate selection bits SPR1 and SPR0 in SPICON SFR set to 0 and 0 respectively.
SCLOCK
(CPOL = 0)
SCLOCK
(CPOL = 1)
MOSI
MISO
MSB IN
BITS 6–1
LSB IN
LSB
MSB
tDAV
tDF
tDR
tSR
tSF
tDHD
tDSU
tSH
tSL
Figure 76. SPI Master Mode Timing (CPHA = 0)
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PDF描述
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參數(shù)描述
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ADUC834BSZ 功能描述:IC ADC DUAL16/24BIT W/MCU 52MQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器, 系列:MicroConverter® ADuC8xx 標(biāo)準(zhǔn)包裝:250 系列:56F8xxx 核心處理器:56800E 芯體尺寸:16-位 速度:60MHz 連通性:CAN,SCI,SPI 外圍設(shè)備:POR,PWM,溫度傳感器,WDT 輸入/輸出數(shù):21 程序存儲器容量:40KB(20K x 16) 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:6K x 16 電壓 - 電源 (Vcc/Vdd):2.25 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 6x12b 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 125°C 封裝/外殼:48-LQFP 包裝:托盤 配用:MC56F8323EVME-ND - BOARD EVALUATION MC56F8323
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