參數(shù)資料
型號(hào)： ADUC7036BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 41/132頁
文件大小： 0K
描述： IC MCU FLASH 96K ANLGI/O 48LFCSP
產(chǎn)品培訓(xùn)模塊： Process Control
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 20.48MHz
連通性： LIN，SPI，UART/USART
外圍設(shè)備： PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 9
程序存儲(chǔ)器容量： 96KB（48K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 1.5K x 32
電壓 - 電源 (Vcc/Vdd)： 3.5 V ~ 18 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 2x16b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 115°C
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
包裝： 托盤
ADuC7036
Rev. C | Page 16 of 132
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
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VB
A
T
VR
E
F
G
ND_S
W
NC
VT
EM
P
IIN
+
II
N
–
AG
ND
AG
ND
NC
RE
G
_
A
V
DD
48
47
46
45
44
43
42
41
40
39
38
37
L
IN/
BS
D
IO
_V
S
ST
I
NC
VSS
NC
VD
D
WU
NC
XT
A
L
2
1
2
3
4
5
6
7
8
9
10
11
12
RESET
GPIO_5/IRQ1/RxD
GPIO_6/TxD
GPIO_7/IRQ4
GPIO_8/IRQ5
TCK
TDI
DGND
NC
TDO
NTRST
TMS
NOTES
1. NC = NO CONNECT.
2. THE EXPOSED PAD SHOULD BE CONNECTED TO DGND.
DGND
REG_DVDD
NC
GPIO_4/ECLK
GPIO_3/MOSI
GPIO_2/MISO
GPIO_1/SCLK
GPIO_0/IRQ0/SS
NC
35
XTAL1
36
34
33
32
31
30
29
28
27
26
25
ADuC7036
TOP VIEW
(Not to Scale)
PIN 1
INDICATOR
07
47
4-
0
07
Figure 7. Pin Configuration
Table 7. Pin Function Descriptions
Pin No.
Mnemonic
Type1
Description
1
RESET
I
Reset Input Pin. Active low. This pin has an internal, weak pull-up resistor to REG_DVDD and
should be left unconnected when not in use. For added security and robustness, it is
recommended that this pin be strapped via a resistor to REG_DVDD.
2
GPIO_5/IRQ1/RxD
I/O
General-Purpose Digital I/O 5/External Interrupt Request 1/Receive Data for UART Serial Port. By
default and after a power-on reset, this pin configures as an input. The pin has an internal, weak
pull-up resistor and should be left unconnected when not in use.
3
GPIO_6/TxD
I/O
General-Purpose Digital I/O 6/Transmit Data for UART Serial Port. By default and after a power-
on reset, this pin configures as an input. The pin has an internal, weak pull-up resistor and
should be left unconnected when not in use.
4
GPIO_7/IRQ4
I/O
General-Purpose Digital I/O 7/External Interrupt Request 4. By default and after a power-on
reset, this pin configures as an input. The pin has an internal, weak pull-up resistor and should
be left unconnected when not in use.
5
GPIO_8/IRQ5
I/O
General-Purpose Digital I/O 8/External Interrupt Request 5. By default and after a power-on
reset, this pin configures as an input. The pin has an internal, weak pull-up resistor and should
be left unconnected when not in use.
6
TCK
I
JTAG Test Clock. This clock input pin is one of the standard 5-pin JTAG debug ports on the part.
TCK is an input pin only and has an internal, weak pull-up resistor. This pin is left unconnected
when not in use.
7
TDI
I
JTAG Test Data Input. This data input pin is one of the standard 5-pin JTAG debug ports on the
part. TDI is an input pin only and has an internal, weak pull-up resistor. This pin can be left
unconnected when not in use.
8, 34, 35
DGND
S
Ground Reference for On-Chip Digital Circuits.
9, 16, 17,
23, 25, 26,
32, 38 to
40, 43, 45
NC
No Connect. These pins are not internally connected and are reserved for possible future use.
Therefore, do not externally connect these pins. These pins can be grounded, if required.
10
TDO
O
JTAG Test Data Output. This data output pin is one of the standard 5-pin JTAG debug ports on
the part. TDO is an output pin only. At power-on, this output is disabled and pulled high via an
internal, weak pull-up resistor. This pin is left unconnected when not in use.
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