Timing Requirements: tIKR
參數(shù)資料
型號： ADSP-2189MKCAZ-300
廠商： Analog Devices Inc
文件頁數(shù)： 21/32頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 144-MBGA
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 主機接口，串行端口
時鐘速率： 75MHz
非易失內(nèi)存： 外部
芯片上RAM： 192kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LFBGA
供應(yīng)商設(shè)備封裝： 144-迷你型BGA
包裝： 托盤
REV. A
ADSP-2189M
–28–
Parameter
Min
Max
Unit
IDMA Read, Long Read Cycle
Timing Requirements:
tIKR
IACK Low before Start of Read1
0ns
tIRK
End of Read after
IACK Low2
2ns
Switching Characteristics:
tIKHR
IACK High after Start of Read1
10
ns
tIKDS
IAD15–0 Data Setup before
IACK Low
0.5tCK – 2ns
tIKDH
IAD15–0 Data Hold after End of Read
2
0ns
tIKDD
IAD15–0 Data Disabled after End of Read
2
10
ns
tIRDE
IAD15–0 Previous Data Enabled after Start of Read
0
ns
tIRDV
IAD15–0 Previous Data Valid after Start of Read
11
ns
tIRDH1
IAD15–0 Previous Data Hold after Start of Read (DM/PM1)
3
2tCK – 3ns
tIRDH2
IAD15–0 Previous Data Hold after Start of Read (PM2)
4
tCK – 5ns
NOTES
1Start of Read =
IS Low and IRD Low.
2End of Read =
IS High or IRD High.
3DM read or first half of PM read.
4Second half of PM read.
tIRK
tIKR
PREVIOUS
DATA
READ
DATA
tIKHR
tIKDS
tIRDV
tIRDH
tIKDD
tIRDE
tIKDH
IAD15–0
IACK
IS
IRD
Figure 31. IDMA Read, Long Read Cycle
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PDF描述
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