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參數(shù)資料
| 型號： | ADSP-21489KSWZ-3A |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 29/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD SIGNAL PROCESSOR 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | SHARC® |
| 類型： | 浮點(diǎn) |
| 接口： | EBI/EMI，DAI，I²C，SPI，SPORT，UART/USART |
| 時鐘速率： | 350MHz |
| 非易失內(nèi)存： | 外部 |
| 芯片上RAM： | 5Mb |
| 電壓 - 輸入/輸出： | 3.30V |
| 電壓 - 核心： | 1.10V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP-EP（14x14） |
| 包裝： | 托盤 |
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Rev. B
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March 2013
AMI Write
Use these specifications for asynchronous interfacing to memo-
ries. Note that timing for AMI_ACK, ADDR, DATA, AMI_RD,
AMI_WR, and strobe timing parameters only apply to asyn-
chronous access mode.
Table 33. AMI Write
Parameter
Min
Max
Unit
Timing Requirements
tDAAK
1, 2
AMI_ACK Delay from Address, Selects
tSDCLK – 9.7 + W
ns
tDSAK
1, 3
AMI_ACK Delay from AMI_WR Low
W – 6
ns
Switching Characteristics
tDAWH
Address Selects to AMI_WR Deasserted
tSDCLK –3.1+ W
ns
tDAWL
Address Selects to AMI_WR Low
tSDCLK –3
ns
tWW
AMI_WR Pulse Width
W – 1.3
ns
tDDWH
Data Setup Before AMI_WR High
tSDCLK –3.7+ W
ns
tDWHA
Address Hold After AMI_WR Deasserted
H + 0.15
ns
tDWHD
Data Hold After AMI_WR Deasserted
H
ns
tDATRWH
4
Data Disable After AMI_WR Deasserted
tSDCLK – 4.3 + H
tSDCLK + 4.9 + H
ns
tWWR
5
AMI_WR High to AMI_WR Low
tSDCLK –1.5+ H
ns
tDDWR
Data Disable Before AMI_RD Low
2 × tSDCLK – 6
ns
tWDE
AMI_WR Low to Data Enabled
tSDCLK – 3.7
ns
W = (number of wait states specified in AMICTLx register) × tSDCLK
H = (number of hold cycles specified in AMICTLx register) × tSDCLK
1 AMI_ACK delay/setup: System must meet tDAAK, or tDSAK, for deassertion of AMI_ACK (low).
2 The falling edge of MSx is referenced.
3 Note that timing for AMI_ACK, AMI_RD, AMI_WR, and strobe timing parameters only applies to asynchronous access mode.
4 See Test Conditions on Page 55 for calculation of hold times given capacitive and dc loads.
5 For Write to Write: tSDCLK + H, for both same bank and different bank. For Write to Read: 3 × tSDCLK + H, for the same bank and different banks.
Figure 20. AMI Write
AMI_ACK
AMI_DATA
tDAWH
tDWHA
tWWR
tDATRWH
tDWHD
tWW
tDDWR
tDDWH
tDAWL
tWDE
tDSAK
tDAAK
AMI_RD
AMI_WR
AMI_ADDR
AMI_MSx
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