參數(shù)資料
型號(hào): ADSP-21478BBCZ-2A
廠商: Analog Devices Inc
文件頁(yè)數(shù): 41/76頁(yè)
文件大小: 0K
描述: IC DSP SHARK 266MHZ 196CSPBGA
標(biāo)準(zhǔn)包裝: 1
系列: SHARC®
類(lèi)型: 浮點(diǎn)
接口: DAI,DPI,EBI/EMI,I²C,SPI,SPORT,UART/USART
時(shí)鐘速率: 266MHz
非易失內(nèi)存: ROM(4Mb)
芯片上RAM: 3Mb
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.20V
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 196-LFBGA,CSPBGA
供應(yīng)商設(shè)備封裝: 196-CSPBGA(12x12)
包裝: 托盤(pán)
Rev. C
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July 2013
The SPORTx_TDV_O output signal (routing unit) becomes
active in SPORT multichannel/packed mode. During transmit
slots (enabled with active channel selection registers), the
SPORTx_TDV_O is asserted for communication with external
devices.
Table 38. Serial Ports—TDV (Transmit Data Valid)
88-Lead LFCSP Package
All Other Packages
Unit
Parameter
Min
Max
Min
Max
Switching Characteristics1
tDRDVEN
TDV Assertion Delay from Drive Edge of External Clock
3
ns
tDFDVEN
TDV Deassertion Delay from Drive Edge of External Clock
2 × tPCLK
13.25
ns
tDRDVIN
TDV Assertion Delay from Drive Edge of Internal Clock
–0.1
ns
tDFDVIN
TDV Deassertion Delay from Drive Edge of Internal Clock
3.5
ns
1 Referenced to drive edge.
Figure 25. Serial Ports—TDV Internal and External Clock
DRIVE EDGE
DAI_P20–1
(SCLK, EXT)
tDRDVEN
tDFDVEN
DRIVE EDGE
DAI_P20–1
(SCLK, INT)
tDRDVIN
tDFDVIN
TDVx
DAI_P20-1
TDVx
DAI_P20-1
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