參數(shù)資料
型號： ADF4002BRUZ-RL7
廠商： Analog Devices Inc
文件頁數(shù)： 4/20頁
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描述： IC PLL FREQUENCY SYNTH 16-TSSOP
設(shè)計(jì)資源： Very Low Jitter Encode (Sampling) Clocks for High Speed Analog-to-Digital Converters Using ADF4002 (CN0003)
標(biāo)準(zhǔn)包裝： 1,000
類型： 時(shí)鐘/頻率合成器（RF），相位檢測器
PLL： 是
輸入： CMOS，TTL
輸出： 時(shí)鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:1
差分 - 輸入:輸出： 是/無
頻率 - 最大： 400MHz
除法器/乘法器： 是/無
電源電壓： 2.7 V ~ 3.3 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 帶卷 (TR)
配用： EVAL-ADF4002EBZ1-ND - BOARD EVAL FOR ADF4002
ADF4002
Data Sheet
Rev. C | Page 12 of 20
N COUNTER LATCH MAP
DB20
DB19
DB18
DB17
DB16
DB15
DB14
DB13
DB12
DB11
DB10
DB9
DB8
DB7
DB6
DB5
DB4
DB3
DB2
DB1
DB0
C2 (0)
C1 (1)
B1
B2
B3
B4
B5
B6
B7
B8
B9
B10
B11
B12
B13
X
DB21
DB22
DB23
G1
0
1
0
F4 (FUNCTION LATCH)
FASTLOCK ENABLE
1
X
N13
N12
N11
N3
N2
N1
0
..........
0
..........
0
1
0
..........
0
1
0
..........
0
1
3
.
..........
.
..........
.
..........
.
1
..........
1
0
8188
1
..........
1
0
1
8189
1
..........
1
0
8190
1
..........
1
8191
X = DON’T CARE
RESERVED
13-BIT N COUNTER
RESERVED
CONTROL
BITS
C
P
GA
IN
N COUNTER DIVIDE RATIO
NOT ALLOWED
1
2
THESE BITS ARE NOT USED
BY THE DEVICE AND ARE
DON'T CARE BITS.
OPERATION
CP GAIN
CHARGE PUMP CURRENT
SETTING 1 IS PERMANENTLY USED.
CHARGE PUMP CURRENT
SETTING 2 IS PERMANENTLY USED.
CHARGE PUMP CURRENT
SETTING 1 IS USED.
CHARGE PUMP CURRENT IS
SWITCHED TO SETTING 2. THE
TIME SPENT IN SETTING 2 IS
DEPENDENT ON WHICH FASTLOCK
MODE IS USED. SEE FUNCTION
LATCH DESCRIPTION.
THESE BITS ARE NOT USED
BY THE DEVICE AND ARE
DON'T CARE BITS.
06052-
016
Figure 17. N Counter Latch Map
相關(guān)PDF資料
PDF描述
ADF4007BCPZ-RL7 IC DIVIDER/PLL SYNTHESZR 20LFCSP
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參數(shù)描述
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ADF4002SRUZ-EP 功能描述:IC PLL FREQUENCY SYNTH 16TSSOP 制造商:analog devices inc. 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:96
ADF4002SRUZ-EP-RL7 功能描述:IC PLL FREQUENCY SYNTH 16TSSOP 制造商:analog devices inc. 系列:* 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1,000
ADF4007 制造商:AD 制造商全稱:Analog Devices 功能描述:High Frequency Divider/PLL Synthesizer
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