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參數(shù)資料
| 型號： | ADAV803ASTZ-REEL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 47/60頁 |
| 文件大小： | 0K |
| 描述： | IC CODEC AUDIO R-DVD 3.3V 64LQFP |
| 標準包裝： | 1,500 |
| 類型： | 音頻編解碼器 |
| 數(shù)據(jù)接口： | 串行 |
| 分辨率（位）： | 24 b |
| ADC / DAC 數(shù)量： | 2 / 2 |
| 三角積分調(diào)變： | 無 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 102 / 101 |
| 電壓 - 電源，模擬： | 3 V ~ 3.6 V |
| 電壓 - 電源，數(shù)字： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-LQFP（10x10） |
| 包裝： | 帶卷 (TR) |
| 配用： | EVAL-ADAV803EBZ-ND - BOARD EVALUATION FOR ADAV803 |
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ADAV803
Rev. A | Page 51 of 60
ADC Control Register 1—Address 1101110 (0x6E)
Table 116. ADC Control Register 1 Bit Map
7
6
5
4
3
2
1
0
AMC
HPF
PWRDWN
ANA_PD
MUTER
MUTEL
PLPD
PRPD
Table 117. ADC Control Register 1 Bit Descriptions
Bit Name
Description
AMC
ADC modulator clock.
0 = ADC MCLK/2 (128 × fS).
1 = ADC MCLK/4 (64 × fS).
HPF
High-pass filter enable.
0 = Normal.
1 = HPF enabled.
PWRDWN
ADC power-down.
0 = Normal.
1 = Power-down.
ANA_PD
ADC analog section power-down.
0 = Normal.
1 = Power-down.
MUTER
Mute ADC right channel.
0 = Normal.
1 = Muted.
MUTEL
Mute ADC left channel.
0 = Normal.
1 = Muted.
PLPD
PGA left power-down.
0 = Normal.
1 = Power-down.
PRPD
PGA right power-down.
0 = Normal.
1 = Power-down.
ADC Control Register 2—Address 1101111 (0x6F)
Table 118. ADC Control Register 2 Bit Map
7
6
5
4
3
2
1
0
Reserved
BUF_PD
Reserved
MCD1
MCD0
Table 119. ADC Control Register 2 Bit Descriptions
Bit Name
Description
BUF_PD
Reference buffer power-down control.
0 = Normal.
1 = Power-down.
MCD[1:0]
ADC master clock divider.
00 = Divide by 1.
01 = Divide by 2.
10 = Divide by 3.
11 = Divide by 1.
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