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參數(shù)資料
| 型號： | ADAU1381BCBZ-RL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 66/84頁 |
| 文件大小： | 0K |
| 描述： | IC AUDIO CODEC STEREO LN 30WLCSP |
| 標準包裝： | 1 |
| 類型： | 立體聲音頻 |
| 數(shù)據(jù)接口： | 串行，SPI? |
| 分辨率（位）： | 24 b |
| ADC / DAC 數(shù)量： | 2 / 2 |
| 三角積分調(diào)變： | 無 |
| S/N 比，標準 ADC / DAC (db)： | 97 / 100 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 96.5 / 100 |
| 電壓 - 電源，模擬： | 1.8 V ~ 3.65 V |
| 電壓 - 電源，數(shù)字： | 1.63 V ~ 3.65 V |
| 工作溫度： | -25°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 30-UFBGA，WLCSP |
| 供應(yīng)商設(shè)備封裝： | 30-WLCSP（3.4x2.64） |
| 包裝： | 標準包裝 |
| 配用： | EVAL-ADAU1381Z-ND - BOARD EVALUATION FOR ADAU1381 |
| 其它名稱： | ADAU1381BCBZ-RL7DKR |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁當前第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁
ADAU1381
Rev. B | Page 69 of 84
Register 16427 (0x402B), Left DAC Attenuator
Bits[7:0], Left DAC Digital Attenuator
These bits control a 256-step, logarithmically spaced volume
control from 0 dB to 95.625 dB, in increments of 0.375 dB.
When a new value is entered into this register, the volume control
slews gradually to the new value, avoiding pops and clicks in the
process. The slew ramp is logarithmic, incrementing 0.375 dB
per audio frame.
Register 16428 (0x402C), Right DAC Attenuator
Bits[7:0], Right DAC Digital Attenuator
These bits control a 256-step, logarithmically spaced volume
control from 0 dB to 95.625 dB, in increments of 0.375 dB.
When a new value is entered into this register, the volume control
slews gradually to the new value, avoiding pops and clicks in the
process. The slew ramp is logarithmic, incrementing 0.375 dB
per audio frame.
Table 57. Left DAC Attenuator Register
Bits
Description
Default
[7:0]
Left DAC digital attenuator, in increments of 0.375 dB with each step of slewing
00000000
00000000: 0 dB
00000001: 0.375 dB
00000010: 0.75 dB
…
11111110: 95. 25
11111111: 95.625 dB
Table 58. Right DAC Attenuator Register
Bits
Description
Default
[7:0]
Right DAC digital attenuator, in increments of 0.375 dB with each step of slewing
00000000
00000000: 0 dB
00000001: 0.375 dB
00000010: 0.75 dB
…
11111110: 95. 25
11111111: 95.625 dB
相關(guān)PDF資料 |
PDF描述 |
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| ADAU1381BCBZ-RL | IC AUDIO CODEC STEREO LN 30WLCSP |
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參數(shù)描述 |
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