參數(shù)資料
型號: ADAU1381BCBZ-RL7
廠商: Analog Devices Inc
文件頁數(shù): 46/84頁
文件大?。?/td> 0K
描述: IC AUDIO CODEC STEREO LN 30WLCSP
標準包裝: 1
類型: 立體聲音頻
數(shù)據(jù)接口: 串行,SPI?
分辨率(位): 24 b
ADC / DAC 數(shù)量: 2 / 2
三角積分調(diào)變:
S/N 比,標準 ADC / DAC (db): 97 / 100
動態(tài)范圍,標準 ADC / DAC (db): 96.5 / 100
電壓 - 電源,模擬: 1.8 V ~ 3.65 V
電壓 - 電源,數(shù)字: 1.63 V ~ 3.65 V
工作溫度: -25°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 30-UFBGA,WLCSP
供應商設(shè)備封裝: 30-WLCSP(3.4x2.64)
包裝: 標準包裝
配用: EVAL-ADAU1381Z-ND - BOARD EVALUATION FOR ADAU1381
其它名稱: ADAU1381BCBZ-RL7DKR
ADAU1381
Rev. B | Page 50 of 84
Register 16398 (0x400E), Record Gain Left PGA
The record gain left PGA control register controls the left channel
input PGA. This register configures the input for either differ-
ential or single-ended signals and sets the left channel input
recording volume.
Bits[7:5], Left Input Gain
These bits set the left channel analog microphone input PGA gain.
Bit 2, Single-Ended Left Input Enable
If this bit is high (enabled), a single-ended input can be input on
the LMIC pin and gained by the PGA. The positive differential
input pin (LMICP) is disabled, and the complementary input of
the PGA is switched to common mode.
Bit 1, Record Path Left Mute
This bit mutes the left channel input PGA.
Bit 0, Left PGA Enable
This bit enables the left channel input PGA
Table 37. Record Gain Left PGA Register
Bits
Description
Default
[7:5]
Left input gain
000
000: 0 dB
001: 6 dB
010: 10 dB
011: 14 dB
100: 17 dB
101: 20 dB
110: 26 dB
111: 32 dB
[4:3]
Reserved
2
Single-ended left input enable
0
0: disabled
1: enabled
1
Record path left mute
0
0: muted
1: unmuted
0
Left PGA enable
0
0: disabled
1: enabled
相關(guān)PDF資料
PDF描述
ADAU1381BCBZ-RL IC AUDIO CODEC STEREO LN 30WLCSP
VI-B3K-IW-B1 CONVERTER MOD DC/DC 40V 100W
VI-B3H-IW-B1 CONVERTER MOD DC/DC 52V 100W
VI-B3B-IW-B1 CONVERTER MOD DC/DC 95V 100W
VE-J3B-IX-S CONVERTER MOD DC/DC 95V 75W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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