參數(shù)資料
型號： ADAU1328BSTZ
廠商： Analog Devices Inc
文件頁數(shù)： 32/32頁
文件大?。?/td> 0K
描述： IC CODEC 24BIT 2ADC/8DAC 48LQFP
標準包裝： 1
類型： 通用
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 8
三角積分調(diào)變： 是
S/N 比，標準 ADC / DAC (db)： 94 / 94
動態(tài)范圍，標準 ADC / DAC (db)： 105 / 106
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應商設備封裝： 48-LQFP（7x7）
包裝： 托盤
Data Sheet
ADAU1328
Rev. B | Page 9 of 32
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
AV
DD
48
LF
47
ADC2RN
46
ADC2RP
45
ADC2L
N
44
ADC2L
P
43
ADC1RN
42
ADC1RP
41
ADC1L
N
40
ADC1L
P
39
CM
38
AV
DD
37
DV
DD
13
DS
DAT
A3
14
DS
DAT
A2
15
DS
DAT
A1
16
DBCL
K
17
DL
RCL
K
18
AS
DAT
A2
19
AS
DAT
A1
20
ABCL
K
21
AL
RCL
K
22
CI
N/
ADR0
23
CO
UT
/S
DA
24
AGND
1
MCLKI/XI
2
MCLKO/XO
3
AGND
4
AVDD
5
OL3
6
OR3
7
OL4
8
OR4
9
PD/RST 10
DSDATA4
11
DGND 12
AGND
36
FILTR
35
AGND
34
AVDD
33
AGND
32
OR2
31
OL2
30
OR1
29
OL1
28
CLATCH/ADR1
27
CCLK/SCL
26
DGND
25
ADAU1328
TOP VIEW
(Not to Scale)
SINGLE-ENDED
OUTPUT
06102-
020
Figure 2. Pin Configuration
Table 9. Pin Function Description
Pin No.
In/Out
Mnemonic
Description
1
I
AGND
Analog Ground.
2
I
MCLKI/XI
Master Clock Input/Crystal Oscillator Input.
3
O
MCLKO/XO
Master Clock Output/Crystal Oscillator Output.
4
I
AGND
Analog Ground.
5
I
AVDD
Analog Power Supply. Connect to analog 3.3 V supply.
6
O
OL3
DAC 3 Left Output.
7
O
OR3
DAC 3 Right Output.
8
O
OL4
DAC 4 Left Output.
9
O
OR4
DAC 4 Right Output.
10
I
PD/RST
Power-Down Reset (Active Low).
11
I/O
DSDATA4
DAC Serial Data Input 4. Data input to DAC4 data in/TDM DAC2 data out (dual-line mode)/AUX
DAC2 data out (to external DAC2).
12
I
DGND
Digital Ground.
13
I
DVDD
Digital Power Supply. Connect to digital 3.3 V supply.
14
I/O
DSDATA3
DAC Serial Data Input 3. Data input to DAC3 data in/TDM DAC2 data in (dual-line mode)/AUX ADC2
data in (from external ADC2).
15
I/O
DSDATA2
DAC Serial Data Input 2. Data input to DAC2 data in/TDM DAC data out/AUX ADC1 data in (from
external ADC1).
16
I
DSDATA1
DAC Serial Data Input 1. Data input to DAC1 data in/TDM DAC data in/TDM data in.
17
I/O
DBCLK
Bit Clock for DACs.
18
I/O
DLRCLK
LR Clock for DACs.
19
I/O
ASDATA2
ADC Serial Data Output 2. Data output from ADC2/TDM ADC data in/AUX DAC1 data out (to
external DAC1).
20
O
ASDATA1
ADC Serial Data Output 1. Data output from ADC1/TDM ADC data out/TDM data out.
21
I/O
ABCLK
Bit Clock for ADCs.
22
I/O
ALRCLK
LR Clock for ADCs.
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