參數(shù)資料
型號： ADAU1328BSTZ
廠商： Analog Devices Inc
文件頁數(shù)： 24/32頁
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描述： IC CODEC 24BIT 2ADC/8DAC 48LQFP
標(biāo)準(zhǔn)包裝： 1
類型： 通用
數(shù)據(jù)接口： 串行
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 8
三角積分調(diào)變： 是
S/N 比，標(biāo)準(zhǔn) ADC / DAC (db)： 94 / 94
動態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 105 / 106
電壓 - 電源，模擬： 3 V ~ 3.6 V
電壓 - 電源，數(shù)字： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 托盤
ADAU1328
Data Sheet
Rev. B | Page 30 of 32
APPLICATION CIRCUITS
Typical applications circuits are shown in Figure 29 through
Figure 32. Figure 29 shows a typical ADC input filter circuit.
Recommended loop filters for LR clock and master clock as the
PLL reference are shown in Figure 30. Output filters for the
DAC outputs are shown in Figure 31 and Figure 32 for the
noninverting and inverting cases, respectively.
2
1
3
OP275
–
+
6
7
5
OP275
–
+
5.76k
237
5.76k
120pF
600Z
AUDIO
INPUT
100pF
5.76k
120pF
4.7F
+
237
4.7F
+
100pF
1nF
NPO
1nF
NPO
ADCxN
ADCxP
06102-
023
Figure 29. Typical ADC Input Filter Circuit
39nF
+
2.2nF
LF
LRCLK
AVDD2
3.32k
5.6nF
390nF
LF
MCLK
AVDD2
562
06102-
027
Figure 30. Recommended Loop Filters for LRCLK or MCLK PLL Reference
3
1
2
OP275
+
–
4.75k
4.7F
+
DAC OUT
240pF
NPO
270pF
NPO
3.3nF
NPO
AUDIO
OUTPUT
4.99k
604
4.99k
49.9k
06102-
024
Figure 31. Typical DAC Output Filter Circuit (Single-Ended, Noninverting)
2
1
3
OP275
–
+
3.01k
11k
4.7F
+
DAC
OUT
CM
0.1F
270pF
NPO
68pF
NPO
2.2nF
NPO
AUDIO
OUTPUT
604
49.9k
11k
06102-
025
Figure 32. Typical DAC Output Filter Circuit (Single-Ended, Inverting)
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PDF描述
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