參數(shù)資料
型號： AD9257BCPZRL7-40
廠商： Analog Devices Inc
文件頁數(shù)： 27/40頁
文件大?。?/td> 0K
描述： IC ADC 14BIT SRL 40MSPS 64LFCSP
標(biāo)準(zhǔn)包裝： 750
位數(shù)： 14
采樣率（每秒）： 40M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 8
功率耗散（最大）： 434mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
輸入數(shù)目和類型： 8 個差分
Data Sheet
AD9257
Rev. A | Page 33 of 40
Reg.
Addr.
(Hex)
Register Name
Bit 7
(MSB)
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0 (LSB)
Default
Value
(Hex)
Comments
0x19
USER_PATT1_LSB
(global)
B7
B6
B5
B4
B3
B2
B1
B0
0x00
User Defined
Pattern 1 LSB.
0x1A
USER_PATT1_MSB
(global)
B15
B14
B13
B12
B11
B10
B9
B8
0x00
User Defined
Pattern 1 MSB.
0x1B
USER_PATT2_LSB
(global)
B7
B6
B5
B4
B3
B2
B1
B0
0x00
User Defined
Pattern 2 LSB.
0x1C
USER_PATT2_MSB
(global)
B15
B14
B13
B12
B11
B10
B9
B8
0x00
User Defined
Pattern 2 MSB.
0x21
Serial control
(global)
LVDS
output
LSB first
Word-wise DDR, 1-lane, Bits[6:4]
100 = DDR 1-lane
PLL low
encode
rate mode
Open
Serial output number
of bits
01 = 14 bits
10 = 12 bits
0x41
Serial stream
control.
Default causes
MSB first and
the native bit
stream.
0x22
Serial channel
status (local)
Open
Channel
output
reset
Channel
power-
down
0x00
Used to power
down
individual
sections of
a converter.
0x100
Resolution/
sample rate
override
Open
Resolution/
sample-rate
override
enable
Resolution
01 = 14 bits
10 = 12 bits
Open
Sample rate
000 = 20 MSPS
001 = 40 MSPS
010 = 50 MSPS
011 = 65 MSPS
0x00
Resolution/
sample rate
override
(requires
transfer bit,
0xFF).
0x101
User I/O Control 2
Open
SDIO pull-
down
0x00
Disables SDIO
pull-down.
0x102
User I/O Control 3
Open
VCM
power-
down
Open
0x00
VCM control.
0x109
Sync
Open
Sync
next
only
Enable sync
0x00
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PDF描述
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