參數(shù)資料
型號(hào): AD602JCHIPS
廠商: ANALOG DEVICES INC
元件分類: 模擬信號(hào)調(diào)理
英文描述: Dual, Low Noise, Wideband Variable Gain Amplifiers
中文描述: SPECIALTY ANALOG CIRCUIT, UUC
封裝: DIE
文件頁(yè)數(shù): 14/28頁(yè)
文件大小: 432K
代理商: AD602JCHIPS
AD600/AD602
Rev. E | Page 14 of 28
90
–10
3.0
20
0
0
10
–0.5
50
30
40
60
70
80
2.5
2.0
1.5
1.0
0.5
V
C
O
COMBINED
A1
A2
0
Figure 27. Plot of Separate and Overall Gains in Sequential Control
5
–8
3.0
–5
–7
0
–6
–0.5
–2
–4
–3
–1
1
2
4
3
0
1.5
1.0
0.5
V
C
G
2.0
2.5
0
Figure 28. Gain Error for Cascaded Stages—Sequential Control
5
–3
–5
0
–4
–0.1
0
–2
–1
1
2
3
4
1.2
1.0
0.8
G
V
C
–6
0.2
0.4
0.6
0
Figure 29. Gain Error for Cascaded Stages—Parallel Control
75
30
1.4
40
35
0.2
0
45
50
55
60
65
70
1.2
1.0
0.8
0.6
0.4
S
V
C
0
Figure 30. SNR for Cascaded Stages—Parallel Control
1.2
–1.2
1.3
–0.6
–1.0
0.1
–0.8
0
0.0
–0.4
–0.2
0.2
0.4
0.6
1.0
0.8
1.2
1.1
1.0
0.9
0.7
0.6
0.5
0.4
0.3
G
V
C
0.2
0.8
0
Figure 31. Gain Error for Cascaded Stages—Low Ripple Mode
80
35
1.4
45
40
0.2
0
50
55
60
65
70
75
1.2
1.0
0.8
0.6
0.4
V
C
S
0
Figure 32. SNR vs. Control Voltage—Low Ripple Mode
相關(guān)PDF資料
PDF描述
AD602JNZ Dual, Low Noise, Wideband Variable Gain Amplifiers
AD602JRZ Dual, Low Noise, Wideband Variable Gain Amplifiers
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AD606 50 MHz, 80 dB Demodulating Logarithmic Amplifier with Limiter Output(50MHz,帶限幅輸出80dB解調(diào)對(duì)數(shù)放大器)
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