VPP = 210 V, V
參數(shù)資料
型號： AD5535ABCZ
廠商： Analog Devices Inc
文件頁數(shù)： 12/16頁
文件大?。?/td> 0K
描述： IC DAC 14BIT 32CHAN 124CSPBGA
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 1
設(shè)置時間： 65µs
位數(shù)： 14
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 32
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 594mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 124-LBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 124-CSPBGA（15x15）
包裝： 托盤
輸出數(shù)目和類型： 32 電壓，單極
采樣率（每秒）： 1.2M
配用： EVAL-AD5535EBZ-ND - BOARD EVALUATION FOR AD5535
AD5535
Rev. A | Page 5 of 16
TIMING CHARACTERISTICS
VPP = 210 V, V = –5 V, V+ = +5 V; AVCC = 5.25 V; DVCC = 2.7 V to 5.25 V; AGND = DGND = DAC_GND = 0 V; REF_IN = 4.096 V.
All specifications TMIN to TMAX, unless otherwise noted.
Table 2.
Parameter
A Grade
Unit
Conditions/Comments
f
1.2
MHz max
Channel Update Rate
UPDATE
f
30
MHz max
SCLK Frequency
CLKIN
t1
13
ns min
SCLK High Pulse Width
t
13
ns min
SCLK Low Pulse Width
2
t3
15
ns min
SYNC Falling Edge to SCLK Falling Edge Setup Time
t4
50
ns min
SYNC Low Time
t5
10
ns min
SYNC High Time
t6
10
ns min
DIN Setup Time
t7
5
ns min
DIN Hold Time
t8
200
ns min
19th SCLK Falling Edge to SYNC Falling Edge for Next Write
t9
20
ns min
RESET Pulse Width
2 Guaranteed by design and characterization, not production tested.
3 All input signals are specified with tr = tf = 5 ns (10% to 90% of DVCC) and timed from a voltage level of (VIL + V )/2.
IH
1
LSB
16
17
18
19
MSB
1
RESET
23
4
5
t8
t7
t6
t4
t9
DIN
SYNC
SCLK
t5
t3
t2
t1
05068-002
Figure 2. Serial Interface Timing Diagram
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PDF描述
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ad5535bru 制造商:Analog Devices 功能描述:
AD5539 制造商:AD 制造商全稱:Analog Devices 功能描述:Ultrahigh Frequency Operational Amplifier
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