參數資料
| 型號： | A54SX08-VQ100I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 15/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA SX 12K GATES 100-VQFP |
| 標準包裝： | 90 |
| 系列： | SX |
| LAB/CLB數： | 768 |
| 輸入/輸出數： | 81 |
| 門數： | 12000 |
| 電源電壓： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-TQFP |
| 供應商設備封裝： | 100-VQFP（14x14） |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁當前第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁
SX Family FPGAs
1- 18
v3.2
Step 3:
Calculate DC Power Dissipation
DC Power Dissipation
PDC = (Istandby) × VCCA + (Istandby) × VCCR + (Istandby) ×
VCCI + X × VOL × IOL + Y(VCCI – VOH) × VOH
EQ 1-12
For a rough estimate of DC Power Dissipation, only use
PDC =(Istandby) × VCCA. The rest of the formula provides a
very small number that can be considered negligible.
PDC = (Istandby) × VCCA
PDC = .55 mA × 3.3 V
PDC = 0.001815 W
Step 4:
Calculate Total Power Consumption
PTotal = PAC + PDC
PTotal = 1.461 + 0.001815
PTotal = 1.4628 W
Step 5:
Compare Estimated Power Consumption
against Characterized Power Consumption
The estimated total power consumption for this design is
1.46 W. The characterized power consumption for this
design at 200 MHz is 1.0164 W.
Step 1:
Define Terms Used in Formula
VCCA
3.3
Module
Number of logic modules switching
at fm (Used 50%)
m
264
Average logic modules switching rate
fm (MHz) (Guidelines: f/10)
fm
20
Module capacitance CEQM (pF)
CEQM
4.0
Input Buffer
Number of input buffers switching at fn
n1
Average input switching rate fn (MHz)
(Guidelines: f/5)
fn
40
Input buffer capacitance CEQI (pF)
CEQI
3.4
Output Buffer
Number of output buffers switching at fp p1
Average output buffers switching rate
fp(MHz) (Guidelines: f/10)
fp
20
Output buffers buffer capacitance
CEQO (pF)
CEQO
4.7
Output Load capacitance CL (pF)
CL
35
RCLKA
Number of Clock loads q1
q1
528
Capacitance of routed array clock (pF)
CEQCR 1.6
Average clock rate (MHz)
fq1
200
Fixed capacitance (pF)
r1
138
RCLKB
Number of Clock loads q2
q2
0
Capacitance of routed array clock (pF)
CEQCR 1.6
Average clock rate (MHz)
fq2
0
Fixed capacitance (pF)
r2
138
HCLK
Number of Clock loads
s1
0
Variable capacitance of dedicated
array clock (pF)
CEQHV 0.61
5
Fixed capacitance of dedicated
array clock (pF)
CEQHF 96
Average clock rate (MHz)
fs1
0
Step 2:
Calculate Dynamic Power Consumption
VCCA × VCCA
10.89
m × fm × CEQM
0.02112
n × fn × CEQI
0.000136
p × fp × (CEQO+CL)
0.000794
0.5 (q1 × CEQCR × fq1) + (r1 × fq1)
0.11208
0.5(q2 × CEQCR × fq2) + (r2 × fq2)0
0.5 (s1 × CEQHV × fs1) + (CEQHF × fs1)0
PAC = 1.461 W
相關PDF資料 |
PDF描述 |
|---|---|
| A54SX08-VQG100I | IC FPGA SX 12K GATES 100-VQFP |
| A54SX08-1VQ100 | IC FPGA SX 12K GATES 100-VQFP |
| A54SX08-1VQG100 | IC FPGA SX 12K GATES 100-VQFP |
| A42MX16-PQG208 | IC FPGA MX SGL CHIP 24K 208-PQFP |
| A42MX16-PQ208 | IC FPGA MX SGL CHIP 24K 208-PQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| A54SX08-VQ100M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| A54SX08-VQ208 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:54SX Family FPGAs |
| A54SX08-VQ208I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:54SX Family FPGAs |
| A54SX08-VQ208M | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:54SX Family FPGAs |
| A54SX08-VQ208PP | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:54SX Family FPGAs |
發(fā)布緊急采購，3分鐘左右您將得到回復。