Revision 13 2-13 Figure 2-3 Input Buffer Timing Model and Delays (example) (R) PAD Y GND (F) 50% (R) (F) (R) " />
參數(shù)資料
型號: A3PE600-2FGG484I
廠商: Microsemi SoC
文件頁數(shù): 83/162頁
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描述: IC FPGA 600000 GATES 484-FBGA
標(biāo)準(zhǔn)包裝: 40
系列: ProASIC3E
RAM 位總計(jì): 110592
輸入/輸出數(shù): 270
門數(shù): 600000
電源電壓: 1.425 V ~ 1.575 V
安裝類型: 表面貼裝
工作溫度: -40°C ~ 85°C
封裝/外殼: 484-BGA
供應(yīng)商設(shè)備封裝: 484-FPBGA(23x23)
ProASIC3E Flash Family FPGAs
Revision 13
2-13
Figure 2-3 Input Buffer Timing Model and Delays (example)
(R)
PAD
Y
GND
(F)
50%
(R)
(F)
(R)
DIN
GND
(F)
50%
PAD
Y
D
CLK
Q
I/O Interface
DIN
To Array
tDIN
VCC
tPYS
tPY
tPYS
tPY
VCC
Vtrip
VIH
VIL
tPY = MAX(tPY(R), tPY(F))
tDIN = MAX(tDIN(R), tDIN(F))
tPY
tDIN
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PDF描述
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