2-54 Revision 13 Fully Registered I/O Buffers with Synchronous Enable and Asynchronous Clear<" />
參數(shù)資料
型號： A3PE3000-2FG324
廠商： Microsemi SoC
文件頁數(shù)： 128/162頁
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 3M 324-FBGA
標準包裝： 84
系列： ProASIC3E
RAM 位總計： 516096
輸入/輸出數(shù)： 221
門數(shù)： 3000000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 324-BGA
供應商設備封裝： 324-FBGA（19x19）
ProASIC3E DC and Switching Characteristics
2-54
Revision 13
Fully Registered I/O Buffers with Synchronous Enable and
Asynchronous Clear
Figure 2-26 Timing Model of the Registered I/O Buffers with Synchronous Enable and Asynchronous Clear
Enable
CLK
Pad
Out
CLK
Enable
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
D_Enable
BB
CC
DD
EE
FF
GG
LL
HH
JJ
KK
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
相關(guān)PDF資料
PDF描述
M1A3PE3000-2FGG324 IC FPGA 1KB FLASH 3M 324-FBGA
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GSC70DRSD-S273 CONN EDGECARD 140PS DIP .100 SLD
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ASC50DREI-S13 CONN EDGECARD 100POS .100 EXTEND
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參數(shù)描述
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