2-10 Revision 13 Table 2-13 Summary of I/O Input Buffer Power (per pin) – Defa" />
參數(shù)資料
型號(hào)： A3P250L-FGG144I
廠商： Microsemi SoC
文件頁(yè)數(shù)： 162/242頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 250K 144-FBGA
標(biāo)準(zhǔn)包裝： 160
系列： ProASIC3L
RAM 位總計(jì)： 36864
輸入/輸出數(shù)： 97
門(mén)數(shù)： 250000
電源電壓： 1.14V ~ 1.575 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 144-LBGA
供應(yīng)商設(shè)備封裝： 144-FPBGA（13x13）
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ProASIC3L DC and Switching Characteristics
2-10
Revision 13
Table 2-13 Summary of I/O Input Buffer Power (per pin) – Default I/O Software Settings1
Applicable to Advanced I/O Banks
VCCI (V)
Static Power
PDC6 (mW)2
Dynamic Power
PAC10 (W/MHz)3
Single-Ended
3.3 V LVTTL / 3.3 V LVCMOS
3.3
–
16.22
2.5 V LVCMOS
2.5
–
4.65
1.8 V LVCMOS
1.8
–
1.65
1.5 V LVCMOS (JESD8-11)
1.5
–
0.98
1.2 V LVCMOS
1.2
–
0.61
3.3 V PCI
3.3
–
17.64
3.3 V PCI-X
3.3
–
17.64
Differential
LVDS
2.5
2.26
0.95
LVPECL
3.3
5.72
1.63
Notes:
1. Dynamic power consumption is given for standard load and software default drive strength and output slew.
2. PDC6 is the static power (where applicable) measured on VCCI.
3. PAC10 is the total dynamic power measured on VCCI.
Table 2-14 Summary of I/O Input Buffer Power (per pin) – Default I/O Software Settings
Applicable to Standard Plus I/O Banks
VCCI (V)
Static Power
PDC6 (mW)1
Dynamic Power
PAC9 (W/MHz)2
Single-Ended
3.3 V LVTTL /
3.3 V LVCMOS
3.3
–
16.23
2.5 V LVCMOS
2.5
–
4.66
1.8 V LVCMOS
1.8
–
1.64
1.5 V LVCMOS (JESD8-11)
1.5
–
0.99
1.2 V LVCMOS
1.2
–
0.58
3.3 V PCI
3.3
–
17.64
3.3 V PCI-X
3.3
–
17.64
Notes:
1. PDC6 is the static power (where applicable) measured on VCCI.
2. PAC9 is the total dynamic power measured on VCCI.
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