參數(shù)資料
型號(hào)： 9S12XDP512DGV1
英文描述： Device User Guide for Mask Set 0L40V ( First Silicon)
中文描述： 設(shè)備用戶指南掩模組0L40V（第一硅）
文件頁(yè)數(shù)： 7/152頁(yè)
文件大小： 1231K
代理商： 9S12XDP512DGV1
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7
Table of Contents
Section 1 Introduction
1.1
1.2
1.3
1.4
1.5
1.6
1.7
Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17
Modes of Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .20
Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .20
Device Memory Map. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .23
Detailed Register Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Part ID Assignments. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63
Section 2 Signal Description
2.1
2.2
2.3
2.3.1
2.3.2
2.3.3
2.3.4
2.3.5
2.3.6
2.3.7
2.3.8
2.3.9
2.3.10
2.3.11
2.3.12
2.3.13
2.3.14
2.3.15
2.3.16
2.3.17
2.3.18
2.3.19
2.3.20
Device Pinout . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .65
Signal Properties Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .68
Detailed Signal Descriptions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .72
EXTAL, XTAL — Oscillator Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .72
RESET — External Reset Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .72
TEST — Test Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .72
VREGEN — Voltage Regulator Enable Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .72
XFC — PLL Loop Filter Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .73
BKGD / MODC — Background Debug and Mode Pin . . . . . . . . . . . . . . . . . . . . . . . .73
PAD[23:08] / AN[15:0] — Port AD Input Pin of ATD1 . . . . . . . . . . . . . . . . . . . . . . . .73
PAD[07:00] / AN[7:0] — Port AD Input Pins of ATD0 . . . . . . . . . . . . . . . . . . . . . . . .73
PA[7:0] / ADDR[15:8] / IVD[15:8] — Port A I/O Pins . . . . . . . . . . . . . . . . . . . . . . . . .73
PB[7:1] / ADDR[7:1] / IVD[7:1] — Port B I/O Pins. . . . . . . . . . . . . . . . . . . . . . . . . . .73
PB0 / ADDR0 / UDS / IVD[0] — Port B I/O Pin. . . . . . . . . . . . . . . . . . . . . . . . . . . . .74
PC[7:0] / DATA [15:8] — Port C I/O Pins. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .74
PD[7:0] / DATA [7:0] — Port D I/O Pins. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .74
PE7 / ECLKX2 / XCLKS — Port E I/O Pin 7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .74
PE6 / MODB / TAGHI — Port E I/O Pin 6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .76
PE5 / MODA / TAGLO / RE — Port E I/O Pin 5. . . . . . . . . . . . . . . . . . . . . . . . . . . . .76
PE4 / ECLK — Port E I/O Pin 4 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .76
PE3 / LSTRB / LDS / EROMCTL— Port E I/O Pin 3 . . . . . . . . . . . . . . . . . . . . . . . . .76
PE2 / R/W / WE— Port E I/O Pin 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .76
PE1 / IRQ — Port E Input Pin 1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .76
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
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