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參數(shù)資料
| 型號： | 82801FB |
| 廠商： | Intel Corp. |
| 英文描述： | Intel I/O Controller Hub 6 (ICH6) Family |
| 中文描述： | 英特爾I / O控制器集線器6（ICH6）家庭 |
| 文件頁數(shù)： | 290/462頁 |
| 文件大?。?/td> | 3450K |
| 代理商： | 82801FB |
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LPC Interface Bridge Registers (D31:F0)
9-44
Intel
82801BA ICH2 Datasheet
9.5.7
VER—Version Register
Index Offset:
Default Value:
01h
00170002h
Attribute:
Size:
RO
32 bits
Each I/O APIC contains a hardwired Version Register that identifies different implementation of
APIC and their versions. The maximum redirection entry information also is in this register, to let
software know how many interrupt are supported by this APIC.
9.5.8
ARBID—Arbitration ID Register
Index Offset:
Default Value:
02h
00000000h
Attribute:
Size:
RO
32 bits
This register contains the bus arbitration priority for the APIC. This register is loaded whenever the
APIC ID register is loaded. A rotating priority scheme is used for APIC bus arbitration. The winner
of the arbitration becomes the lowest priority agent and assumes an arbitration ID of 0.
a
9.5.9
BOOT_CONFIG—Boot Configuration Register
Index Offset:
Default Value:
03h
00000000h
Attribute:
Size:
R/W
32 bits
This register is used to control the interrupt delivery mechanism for the APIC.
a
Bit
Description
31:24
Reserved.
23:16
Maximum Redirection Entries
—RO.
This is the entry number (0 being the lowest entry) of the
highest entry in the redirection table. It is equal to the number of interrupt input pins minus one and
is in the range 0 through 239. In the ICH2 this field is hardwired to 17h to indicate 24 interrupts.
15
PRQ
—RO.
This bit is set to 1 to indicate that this version of the I/O APIC implements the IRQ
Assertion register and allows PCI devices to write to it to cause interrupts.
14 :8
Reserved.
7:0
Version
—RO.
This is a version number that identifies the implementation version.
Bit
Description
31:28
Reserved.
27:24
I/O APIC Identification
—RO.
This 4 bit field contains the I/O APIC Arbitration ID.
23:0
Reserved.
Bit
Description
31:1
Reserved.
0
Delivery Type (DT)
—R/W.
0 = Interrupt delivery mechanism is via the APIC serial bus (default).
1 = Interrupt delivery mechanism is a front-side bus message.
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相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 82801FBM | Intel I/O Controller Hub 6 (ICH6) Family |
| 82801FR | Intel I/O Controller Hub 6 (ICH6) Family |
| 82801DB | Intel 82801DB I/O Controller Hub 4 (ICH4) |
| 82801AA | 82801AB (ICH0) I/O Controller Hub |
| 82801AB | 82801AB (ICH0) I/O Controller Hub |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 82801FBM | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family |
| 82801FR | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 6 (ICH6) Family |
| 82801GBICH7 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GBMICH7-M | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
| 82801GDHICH7DH | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Intel I/O Controller Hub 7 |
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