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參數(shù)資料
| 型號： | 82596CA |
| 廠商： | Intel Corp. |
| 英文描述： | HIGH-PERFORMANCE 32-BIT LOCAL AREA NETWORK COPROCESSOR |
| 中文描述： | 高性能的32位局域網(wǎng)協(xié)處理器 |
| 文件頁數(shù)： | 62/77頁 |
| 文件大小： | 787K |
| 代理商： | 82596CA |
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82596DX/SX
A.C. CHARACTERISTICS
(Continued)
82596DX C-STEP INPUT/OUTPUT SYSTEM TIMINGS
T
C
e
0
§
C to
a
85
§
C, V
CC
e
5V
g
5%
These timings assume the C
L
on all outputs is 50 pF unless otherwise specified. C
L
can be 20 pF to 120 pF,
however, timings must be derated.
All timing requirements are given in nanoseconds.
Symbol
Parameter
33 MHz
Notes
Min
Max
Operating Frequency
12.5 MHz
33 MHz
CLK2/2
T1
CLK2 Period
15
40
T2
CLK2 High
4.5
3.7V
T3
CLK2 Low
4.5
0.8V
T4
CLK2 Rise Time
D
4
3.7V to 0.8V
T5
CLK2 Fall Time
D
4
0.8V to 3.7V
T13
CA and BREQ Setup Time
7
1, 2, 3
T14
BREQ Hold Time
3
1, 2, 3
T14a
CA Hold Time
5
1, 2, 3
T26
CA and BREQ, PORT Pulse Width
4 T1
3
T25
INT Valid Delay
1
20
T6
BEx Valid Delay
3
17
T6b
LOCK Valid Delay
3
16
T6c
A2–A31 Valid Delay
3
18
T7
BEx, LOCK, and A2–A31 Float Delay
4
20
T8
W/R and ADS Valid Delay
3
16
T9
W/R and ADS Float Delay
4
20
T10
D0–D31 Write Data Valid Delay
3
19
T11
D0–D31 Write Data Float Delay
4
17
T27
D0–D31 CPU PORT Access Setup Time
5
2
T28
D0–D31 CPU PORT Access Hold Time
3
2
T29
PORT Setup Time
7
2
T30
PORT Hold Time
3
2
T17
RDY Setup Time
8
2
T18
RDY Hold Time
3
2
T19
D0–D31 READ Setup Time
5.5
2
T20
D0–D31 READ Hold Time
4
2
T12
HOLD Valid Delay
3
19
T21
HLDA Setup Time
8
1, 2
T22a
HLDA Hold Time
3
1, 2
T23
RESET Setup Time
9
2
T24
RESET Hold Time
3
2
NOTE:
Timings shown are for the 82596CA C-Stepping. For information regarding timings for the 82596CA A1 or B-Step, contact
your local Intel representative.
62
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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