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參數(shù)資料
| 型號(hào)： | 68HC12DG128CPV8 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Advance Information |
| 中文描述： | 16-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP112 |
| 封裝： | TQFP-112 |
| 文件頁數(shù)： | 255/424頁 |
| 文件大?。?/td> | 3495K |
| 代理商： | 68HC12DG128CPV8 |
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Inter-IC Bus
IIC Protocol
68HC(9)12DG128 Rev 1.0
MOTOROLA
Inter-IC Bus
255
START Signal
When the bus is free, i.e. no master device is engaging the bus (both
SCL and SDA lines are at logical high), a master may initiate
communication by sending a START signal. As shown in
Figure 39
, a
START signal is defined as a high-to-low transition of SDA while SCL is
high. This signal denotes the beginning of a new data transfer (each data
transfer may contain several bytes of data) and wakes up all slaves.
Slave Address
Transmission
The first byte of data transfer immediately after the START signal is the
slave address transmitted by the master. This is a seven-bit calling
address followed by a R/W bit. The R/W bit tells the slave the desired
direction of data transfer.
1 = Read transfer, the slave transmits data to the master.
0 = Write transfer, the master transmits data to the slave.
Only the slave with a calling address that matches the one transmitted
by the master will respond by sending back an acknowledge bit. This is
done by pulling the SDA low at the 9th clock (see
Figure 39
).
Slave address -
No two slaves in the system may have the same
address. If the IIC is master, it must not transmit an address that
is equal to its own slave address. The IIC cannot be master and
slave at the same time. If however arbitration is lost during an
address cycle the IIC will revert to slave mode and operate
correctly even if it is being addressed by another master.
Data Transfer
Once successful slave addressing is achieved, the data transfer can
proceed byte-by-byte in a direction specified by the R/W bit sent by the
calling master.
NOTE:
All transfers that come after an address cycle are referred to as data
transfers, even if they carry sub-address information for the slave
device.
Each data byte is 8 bits long. Data may be changed only while SCL is low
and must be held stable while SCL is high as shown in
Figure 39
. There
is one clock pulse on SCL for each data bit, the MSB being transferred
first. Each data byte has to be followed by an acknowledge bit, which is
signalled from the receiving device by pulling the SDA low at the ninth
clock. So one complete data byte transfer needs nine clock pulses.
5-iicbus
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 68HC12DG128MPV8 | Advance Information |
| 68HC12DG128PV8 | Advance Information |
| 68HC12DG128VPV8 | Advance Information |
| 68HC12D60 | Pin out and Signal Descriptions |
| 68HC912D60 | Pin out and Signal Descriptions |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 68HC12DG128MPV8 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| 68HC12DG128PV8 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| 68HC12DG128VPV8 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| 68HC16 | 制造商:MAXIM 制造商全稱:Maxim Integrated Products 功能描述:68HC16 Module |
| 68HC16MOD-16WIDE | 功能描述:界面開發(fā)工具 68HC16MOD-16WIDE EVAL KIT RoHS:否 制造商:Bourns 產(chǎn)品:Evaluation Boards 類型:RS-485 工具用于評(píng)估:ADM3485E 接口類型:RS-485 工作電源電壓:3.3 V |
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