參數(shù)資料
型號(hào)： ZPSD503B1-12J
英文描述： Avalanche Bridge Rectifiers
中文描述： 現(xiàn)場(chǎng)可編程外圍
文件頁數(shù)： 127/153頁
文件大小： 1036K
代理商： ZPSD503B1-12J
NOTES:
1. Any input used to select an internal ZPSD5XX function.
2. In multiplexed mode latched address generated from ADIO delay to address output on any Port.
3. WR timing has the same timing as E, DS, LDS, UDS, WRL, WRH signals.
PSD5XX Famly
124
-20
-25
EPROM_CMiser
ON
Symbol
Parameter
Conditions
Min Max Min Max
Unit
t
LVLX
t
AVLX
t
LXAX
ALE or AS Pulse Width
30
30
ns
Address Setup Time
(Note 1)
12
15
ns
Address Hold Time
(Note 1)
12
17
ns
t
AVWL
Address Valid to Leading
Edge of WR
(Notes 1 and 3)
35
50
ns
t
SLWL
t
DVWH
t
WHDX
t
WLWH
CS Valid to Leading Edge of WR
(Note 3)
40
60
ns
WR Data Setup Time
(Note 3)
25
35
ns
WR Data Hold Time
(Note 3)
5
10
ns
WR Pulse Width
(Note 3)
30
30
ns
t
WHAX
Trailing Edge of WR to Address
Invalid
(Note 3)
0
0
ns
t
WHPV
Trailing Edge of WR to Port
Output Valid
(Note 3)
50
60
ns
In 16-Bit Data Bus
Mode (Note 2)
40
60
ns
Address Input Valid to
Address Output Delay
t
AVPV
In 8-Bit Data Bus
Mode (Note 2)
50
60
ns
Write Timng
(3.0 V ± 10%)
Microcontroller Interface – AC/DC Parameters
(ZPSD5XXV Versions)
相關(guān)PDF資料
PDF描述
ZPSD503B1-12JI Avalanche Bridge Rectifiers
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ZPSD503B1-12LM Avalanche Bridge Rectifiers
ZPSD503B1-12U Avalanche Bridge Rectifiers
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