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參數(shù)資料
| 型號： | XRT91L80 |
| 廠商： | Exar Corporation |
| 英文描述： | 2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER |
| 中文描述： | 2.488/2.666 Gbps的STS-48/STM-16的SONET / SDH收發(fā)器 |
| 文件頁數(shù)： | 22/45頁 |
| 文件大?。?/td> | 359K |
| 代理商： | XRT91L80 |
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XRT91L80
2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER
PRELIMINARY
xr
REV. P1.1.0
20
device will set the OVERFLOW pin to a "High" level and will automatically reset and center the FIFO. Figure 11
provides a detailed overview of the transmit FIFO in a system interface.
F
IGURE
11. T
RANSMIT
FIFO
AND
S
YSTEM
I
NTERFACE
3.4
It is required that the FIFO_RST pin be pulled "High" for 2 TXPCLKOP/N cycles to flush out the FIFO after the
device is powered on. If the FIFO experiences an Overflow condition, FIFO_RST can be used to manually
reset the FIFO. However, the STS-48/STM-16 transceiver has an automatic reset pin that will allow the FIFO to
automatically reset upon an Overflow condition. FIFO_AUTORST should be pulled "High" to enable the
automatic FIFO reset function.
3.5
Transmit Parallel Input to Serial Output (PISO)
The PISO is used to convert 622.08/666.51 MHz parallel data input to 2.488/2.666 Gbps serial data output
which can interface to an optical module. The PISO bit interleaves parallel data input into a serial bit stream
taking the first bit from TXDI3P/N, then the first bit from TXDI2P/N, and so on as shown in Figure 12.
FIFO Calibration Upon Power Up
F
IGURE
12. S
IMPLIFIED
B
LOCK
D
IAGRAM
OF
PISO
Write Pointer
Read Pointer
AUTORST
OVERFLOW
RESET
TXPCLKIP/N
REFCLKP/N
FIFO Control
Div by 4
2.488/2.666 GHz PLL
CMU
delay
Upstream Device
4 x 9 FIFO
XRT91L80
TXPCLKOP/N
4
TXDI[3:0]P/N
4
b
0
0
b
0
1
b
0
2
b
0
3
b
0
4
b
0
5
b
0
6
b
0
7
b
1
0
b
1
1
b
1
2
b
1
3
b
1
4
b
1
5
b
1
6
b
1
7
b
2
0
b
2
1
b
2
2
b
2
3
b
2
4
b
2
5
b
2
6
b
2
7
b
3
0
b
3
1
b
3
2
b
3
3
b
3
4
b
3
5
b
3
6
b
3
7
4-bit Parallel LVDS Data Input
TXDI0P/N
TXDI3P/N
TXDI2P/N
TXDI1P/N
TXOP/N
TXPCLKIP/N
622.08/666.51 MHz
2.488/2.666 Gbps
b
0
0
b
1
0
b
2
0
b
3
0
b
0
1
b
1
1
b
2
1
b
3
1
b
0
2
b
1
2
b
2
2
b
3
2
b
0
3
b
1
3
b
2
3
b
3
3
P
time (0)
相關PDF資料 |
PDF描述 |
|---|---|
| XRT91L80_0507 | 2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER |
| XRT91L80IB | 2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER |
| XRT91L81 | 2.488/2.666GBPS OC-48/STM-16 SONET/SDH TRANSCEIVER |
| XRT91L81IB | 2.488/2.666GBPS OC-48/STM-16 SONET/SDH TRANSCEIVER |
| XRT91L82 | 2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT91L80_0507 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.488/2.666 GBPS STS-48/STM-16 SONET/SDH TRANSCEIVER |
| XRT91L80ES | 功能描述:總線收發(fā)器 Transceiver RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| XRT91L80IB | 功能描述:總線收發(fā)器 Transceiver RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| XRT91L80IB-F | 功能描述:總線收發(fā)器 Transceiver RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| XRT91L81 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2.488/2.666GBPS OC-48/STM-16 SONET/SDH TRANSCEIVER |
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