á THREE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER XRT72L53 PRELIMINARY REV" />
參數(shù)資料
型號： XRT72L53IB-F
廠商： Exar Corporation
文件頁數(shù)： 3/467頁
文件大?。?/td> 0K
描述： IC FRAMER DS3/E3 3CH 272PBGA
產品變化通告： XRT72Lx Series Obsolescence 02/May/2012
標準包裝： 40
控制器類型： DS3/E3 調幀器
電源電壓： 3.3V
電流 - 電源： 190mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 272-BBGA
供應商設備封裝： 272-PBGA（27x27）
包裝： 托盤
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á
á THREE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER XRT72L53
PRELIMINARY
REV. P1.1.7
100
2. When the Receive DS3/E3 Framer block detects
the end of the Rx FERF Condition (e.g., when the
FERF bit, within the last 3 or 5 consecutive E3
frames are set to "0").
NOTE: For more information on the Rx FERF (Yellow
Alarm) condition, please see Section 4.3.2.9.
Bit 2 - BIP-4 (Detection of BIP-4) Error Interrupt
Status
This Reset-upon-Read bit-field will be set to "1" if the
BIP-4 Error interrupt has occurred since the last read
of this register.
The Receive DS3/E3 Framer block will generate the
BIP-4 Error interrupt if it has concluded that it has re-
ceived an errored E3 frame, from the Remote Termi-
nal.
NOTE: Please see Section 4.3.6.1.7 for a more detailed dis-
cussion of this interrupt.
Bit 1 - Framing Error Interrupt Status
This Reset-upon-Read bit-field will be set to "1" if the
Framing Byte Error interrupt has occurred since the
last read of this register.
The Receive DS3/E3 Framer block will generate the
Framing Error interrupt if it has detected an error in
the FAS (or Framing Alignment), in an incoming E3
frame.
NOTE: Please see Section 4.3.6.1.8 for a more detailed dis-
cussion of this interrupt.
2.4.4.7
Receive E3 LAPD Control Register (E3,
ITU-T G.751)
Bit 2 - RxLAPD Enable
This Read/Write bit-field allows the user to enable or
disable the LAPD Receiver, for reception of incoming
LAPD Message frames from the Remote LAPD
Transmitter.
Writing a "1" to this bit-field enables the LAPD Re-
ceiver. Writing a "0" to this bit-field disables the LAPD
Receiver.
Bit 1 - RxLAPD (Received LAPD Message) Inter-
rupt Enable
This Read/Write bit-field allows the user to enable or
disable the Received LAPD Message frame interrupt.
Setting this bit-field to "1" enables this interrupt. Set-
ting this bit-field to "0" disables this interrupt.
NOTE: For more information on this interrupt, please see
Section 4.3.6.1.9.
Bit 0 - RxLAPD (Received LAPD Message) Inter-
rupt Status
This Reset-upon-Read bit-field will be set to "1" if the
Receipt of New LAPD Message frame interrupt has
occurred since the last read of this register.
The Receive DS3/E3 Framer block will generate this
Receipt of New LAPD Message frame interrupt when
the LAPD Receiver has received a complete LAPD
Message frame from the Remote LAPD Transmitter.
NOTE: Please see section 4.3.6.1.9 for a more detailed dis-
cussion of this interrupt.
2.4.4.8
Receive E3 LAPD Status Register (E3,
ITU-T G.751)
Bit 6 - RxAbort
RXE3 LAPD CONTROL REGISTER (ADDRESS = 0X18)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
Not Used
RxLAPD
Enable
RxLAPD
Interrupt
Enable
RxLAPD
Interrupt
Enable
RO
R/W
RUR
0
0000
000
RXE3 LAPD STATUS REGISTER (ADDRESS = 0X19)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
Not Used
RxAbort
RxLAPDType[1:0]
RxCR Type
RxFCS Error
End of
Message
Flag Present
RO
0
0000
000
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PDF描述
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XRT72L56ES-PCI 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray
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