參數(shù)資料
型號(hào): XC5VLX50T-1FFG665C
廠商: Xilinx Inc
文件頁(yè)數(shù): 29/91頁(yè)
文件大?。?/td> 0K
描述: IC FPGA VIRTEX-5 50K 665FCBGA
產(chǎn)品變化通告: Step Intro and Pkg Change 11/March/2008
標(biāo)準(zhǔn)包裝: 1
系列: Virtex®-5 LXT
LAB/CLB數(shù): 3600
邏輯元件/單元數(shù): 46080
RAM 位總計(jì): 2211840
輸入/輸出數(shù): 360
電源電壓: 0.95 V ~ 1.05 V
安裝類型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 665-BBGA,F(xiàn)CBGA
供應(yīng)商設(shè)備封裝: 665-FCBGA
配用: 568-5088-ND - BOARD DEMO DAC1408D750
HW-V5-ML561-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
HW-V5-ML550-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
HW-V5-ML521-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
HW-V5GBE-DK-UNI-G-ND - KIT DEV V5 LXT GIGABIT ETHERNET
122-1508-ND - EVALUATION PLATFORM VIRTEX-5
其它名稱: 122-1565
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
35
LVDCI_DV2_25
0.61
0.70
0.82
1.36
1.51
1.74
1.36
1.51
1.74
ns
LVDCI_DV2_18
0.67
0.76
0.89
1.43
1.60
1.85
1.43
1.60
1.85
ns
LVDCI_DV2_15
0.73
0.83
0.98
1.48
1.65
1.91
1.48
1.65
1.91
ns
GTL_DCI
0.76
0.85
1.00
1.36
1.47
1.65
1.36
1.47
1.65
ns
GTLP_DCI
0.76
0.85
1.00
1.37
1.52
1.76
1.37
1.52
1.76
ns
LVPECL_25
0.80
0.90
1.06
1.28
1.42
1.62
1.28
1.42
1.62
ns
HSTL_I_12
0.76
0.85
1.00
1.45
1.61
1.85
1.45
1.61
1.85
ns
HSTL_I_DCI
0.76
0.85
1.00
1.41
1.56
1.77
1.41
1.56
1.77
ns
HSTL_II_DCI
0.76
0.85
1.00
1.34
1.48
1.69
1.34
1.48
1.69
ns
HSTL_II_T_DCI
0.76
0.85
1.00
1.41
1.56
1.77
1.41
1.56
1.77
ns
HSTL_III_DCI
0.76
0.85
1.00
1.57
1.72
1.95
1.57
1.72
1.95
ns
HSTL_IV_DCI
0.76
0.85
1.00
1.34
1.46
1.64
1.34
1.46
1.64
ns
HSTL_I_DCI_18
0.76
0.85
1.00
1.36
1.50
1.70
1.36
1.50
1.70
ns
HSTL_II_DCI_18
0.76
0.85
1.00
1.30
1.43
1.64
1.30
1.43
1.64
ns
HSTL_II _T_DCI_18
0.76
0.85
1.00
1.36
1.50
1.70
1.36
1.50
1.70
ns
HSTL_III_DCI_18
0.76
0.85
1.00
1.55
1.69
1.91
1.55
1.69
1.91
ns
HSTL_IV_DCI_18
0.76
0.85
1.00
1.31
1.44
1.62
1.31
1.44
1.62
ns
DIFF_HSTL_I_18
0.80
0.90
1.06
1.40
1.55
1.77
1.40
1.55
1.77
ns
DIFF_HSTL_I_DCI_18
0.80
0.90
1.06
1.36
1.50
1.70
1.36
1.50
1.70
ns
DIFF_HSTL_I
0.80
0.90
1.06
1.42
1.57
1.79
1.42
1.57
1.79
ns
DIFF_HSTL_I_DCI
0.80
0.90
1.06
1.41
1.56
1.77
1.41
1.56
1.77
ns
DIFF_HSTL_II_18
0.80
0.90
1.06
1.36
1.51
1.72
1.36
1.51
1.72
ns
DIFF_HSTL_II_DCI_18
0.80
0.90
1.06
1.30
1.43
1.64
1.30
1.43
1.64
ns
DIFF_HSTL_II
0.80
0.90
1.06
1.39
1.53
1.74
1.39
1.53
1.74
ns
DIFF_HSTL_II_DCI
0.80
0.90
1.06
1.34
1.48
1.69
1.34
1.48
1.69
ns
SSTL2_I_DCI
0.76
0.85
1.00
1.42
1.56
1.78
1.42
1.56
1.78
ns
SSTL2_II_DCI
0.76
0.85
1.00
1.34
1.48
1.70
1.34
1.48
1.70
ns
SSTL2_II_T_DCI
0.76
0.85
1.00
1.42
1.56
1.78
1.42
1.56
1.78
ns
SSTL18_I
0.76
0.85
1.00
1.46
1.61
1.84
1.46
1.61
1.84
ns
SSTL18_II
0.76
0.85
1.00
1.39
1.53
1.75
1.39
1.53
1.75
ns
SSTL18_I_DCI
0.76
0.85
1.00
1.39
1.53
1.74
1.39
1.53
1.74
ns
SSTL18_II_DCI
0.76
0.85
1.00
1.30
1.44
1.64
1.30
1.44
1.64
ns
SSTL18_II_T_DCI
0.76
0.85
1.00
1.39
1.53
1.74
1.39
1.53
1.74
ns
Table 56: IOB Switching Characteristics (Cont’d)
I/O Standard
TIOPI
TIOOP
TIOTP
Units
Speed Grade
-3
-2
-1
-3
-2
-1
-3
-2
-1
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PDF描述
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