參數(shù)資料
型號(hào)： XC3S400-4FGG320I
廠商： Xilinx Inc
文件頁(yè)數(shù)： 241/272頁(yè)
文件大?。?/td> 0K
描述： SPARTAN-3A FPGA 400K STD 320FBGA
產(chǎn)品培訓(xùn)模塊： Extended Spartan 3A FPGA Family
標(biāo)準(zhǔn)包裝： 84
系列： Spartan®-3
LAB/CLB數(shù)： 896
邏輯元件/單元數(shù)： 8064
RAM 位總計(jì)： 294912
輸入/輸出數(shù)： 221
門數(shù)： 400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 320-BGA
供應(yīng)商設(shè)備封裝： 320-FBGA（19x19）
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Spartan-3 FPGA Family: DC and Switching Characteristics
DS099 (v3.1) June 27, 2013
Product Specification
70
Table 41: System-Synchronous Pin-to-Pin Setup and Hold Times for the IOB Input Path
Symbol
Description
Conditions
Device
Speed Grade
Units
-5
-4
Min
Setup Times
TPSDCM
When writing to the Input
Flip-Flop (IFF), the time from the
setup of data at the Input pin to
the active transition at a Global
Clock pin. The DCM is in use. No
Input Delay is programmed.
LVCMOS25(2),
IOBDELAY = NONE,
with DCM(4)
XC3S50
2.37
2.71
ns
XC3S200
2.13
2.35
ns
XC3S400
2.15
2.36
ns
XC3S1000
2.58
2.95
ns
XC3S1500
2.55
2.91
ns
XC3S2000
2.59
2.96
ns
XC3S4000
2.76
3.15
ns
XC3S5000
2.69
3.08
ns
TPSFD
When writing to IFF, the time from
the setup of data at the Input pin
to an active transition at the
Global Clock pin. The DCM is not
in use. The Input Delay is
programmed.
LVCMOS25(2),
IOBDELAY = IFD,
without DCM
XC3S50
3.00
3.46
ns
XC3S200
2.63
3.02
ns
XC3S400
2.50
2.87
ns
XC3S1000
3.50
4.03
ns
XC3S1500
3.78
4.35
ns
XC3S2000
4.98
5.73
ns
XC3S4000
5.25
6.05
ns
XC3S5000
5.37
6.18
ns
Hold Times
TPHDCM
When writing to IFF, the time from
the active transition at the Global
Clock pin to the point when data
must be held at the Input pin. The
DCM is in use. No Input Delay is
programmed.
LVCMOS25(3),
IOBDELAY = NONE,
with DCM(4)
XC3S50
–0.45
–0.40
ns
XC3S200
–0.12
–0.05
ns
XC3S400
–0.12
–0.05
ns
XC3S1000
–0.43
–0.38
ns
XC3S1500
–0.45
–0.40
ns
XC3S2000
–0.47
–0.42
ns
XC3S4000
–0.61
–0.56
ns
XC3S5000
–0.62
–0.57
ns
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