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參數(shù)資料
| 型號(hào)： | XC3195A-3PQ160C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 63/76頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 484 CLB'S 160-PQFP |
| 產(chǎn)品變化通告： | XC4000XL/E, XC9500XV, XC3100A Discontinuance 12/Apr/2010 |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | XC3000A/L |
| LAB/CLB數(shù)： | 484 |
| RAM 位總計(jì)： | 94984 |
| 輸入/輸出數(shù)： | 138 |
| 門數(shù)： | 7500 |
| 電源電壓： | 4.25 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 160-BQFP |
| 供應(yīng)商設(shè)備封裝： | 160-PQFP（28x28） |
| 其它名稱： | 122-1085 |
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R
XC3000 Series Field Programmable Gate Arrays
7-68
November 9, 1998 (Version 3.1)
XC3064A/XC3090A/XC3195A 84-Pin PLCC Pinouts
XC3000A, XC3000L, XC3100A, and XC3100L families have identical pinouts
Unprogrammed IOBs have a default pull-up. This prevents an undefined pad level for unbonded or unused IOBs.
Programmed outputs are default slew-rate limited.
* In the PC84 package, XC3064A, XC3090A and XC3195A have additional VCC and GND pins and thus a different pin
definition than XC3020A/XC3030A/XC3042A.
PLCC Pin Number
XC3064A, XC3090A, XC3195A
PLCC Pin Number
XC3064A, XC3090A, XC3195A
12
PWRDN
54
RESET
13
TCLKIN-I/O
55
DONE-PG
14
I/O
56
D7-I/O
15
I/O
57
XTL1(OUT)-BCLKIN-I/O
16
I/O
58
D6-I/O
17
I/O
59
I/O
18
I/O
60
D5-I/O
19
I/O
61
CS0-I/O
20
I/O
62
D4-I/O
21
GND*
63
I/O
22
VCC
64
VCC
23
I/O
65
GND*
24
I/O
66
D3-I/O*
25
I/O
67
CS1-I/O*
26
I/O
68
D2-I/O*
27
I/O
69
I/O
28
I/O
70
D1-I/O
29
I/O
71
RDY/BUSY-RCLK-I/O
30
I/O
72
D0-DIN-I/O
31
M1-RDATA
73
DOUT-I/O
32
M0-RTRIG
74
CCLK
33
M2-I/O
75
A0-WS-I/O
34
HDC-I/O
76
A1-CS2-I/O
35
I/O
77
A2-I/O
36
LDC-I/O
78
A3-I/O
37
I/O
79
I/O
38
I/O
80
I/O
39
I/O
81
A15-I/O
40
I/O
82
A4-I/O
41
INIT/I/O*
83
A14-I/O
42
VCC*
84
A5-I/O
43
GND
1
GND
44
I/O
2
VCC*
45
I/O
3
A13-I/O*
46
I/O
4
A6-I/O*
47
I/O
5
A12-I/O*
48
I/O
6
A7-I/O*
49
I/O
7
I/O
50
I/O
8
A11-I/O
51
I/O
9
A8-I/O
52
I/O
10
A10-I/O
53
XTL2(IN)-I/O
11
A9-I/O
Product Obsolete or Under Obsolescence
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