參數(shù)資料
型號(hào)： XA2C128-8CPG132Q
廠商： Xilinx Inc
文件頁數(shù)： 3/16頁
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描述： IC CPLD 128MC 100 I/O 132CSBGA
產(chǎn)品培訓(xùn)模塊： CoolRunner-II CPLD Starter Kit
標(biāo)準(zhǔn)包裝： 360
系列： CoolRunner II
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 7.0ns
電壓電源 - 內(nèi)部： 1.7 V ~ 1.9 V
邏輯元件/邏輯塊數(shù)目： 8
宏單元數(shù)： 128
門數(shù)： 3000
輸入/輸出數(shù)： 100
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 132-TFBGA，CSPBGA
供應(yīng)商設(shè)備封裝： 132-CSPBGA（8x8）
包裝： 托盤
XA2C128 CoolRunner-II Automotive CPLD
DS554 (v1.2) June 9, 2009
Product Specification
11
R
71
77
C12
2
72
78
B12
2
73
-
A12
2
74
79
C11
2
75
80
B11
2
76
81
A11
2
77
-
C10
2
78
-
79
-
710
-
711
82
A10
2
712
-
C9
2
713
85
A8
2
714
86
B8
2
715
87
C8
2
716
89
B7
2
Pin Descriptions (Continued)
Function
Block
Macro-
cell
VQG100
CPG132
I/O Bank
81
-
N14
1
82
53
N13
1
83
52
P14
1
84
50
P12
1
85
-
M11
1
86
49
N11
1
87
-
88
-
89
-
810
-
811
-
P11
1
812
46
P10
1
813
44
P9
1
814
43
M8
1
815
42
N8
1
816
41
P8
1
Notes:
1.
GTS = global output enable, GSR = global reset/set, GCK =
global clock, CDRST = clock divide reset, DGE = DataGATE
enable.
2.
GCK, GSR, and GTS pins can also be used for general
purpose I/O.
Pin Descriptions (Continued)
Function
Block
Macro-
cell
VQG100
CPG132
I/O Bank
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PDF描述
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