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參數(shù)資料
| 型號(hào)： | X9258TS24Z |
| 廠商： | INTERSIL CORP |
| 元件分類： | 數(shù)字電位計(jì) |
| 英文描述： | Quad Digital Controlled Potentiometers |
| 中文描述： | QUAD 100K DIGITAL POTENTIOMETER, 2-WIRE SERIAL CONTROL INTERFACE, 256 POSITIONS, PDSO24 |
| 封裝： | 0.300 INCH, ROHS COMPLIANT, PLASTIC, MS-013ADC, SOIC-24 |
| 文件頁(yè)數(shù)： | 8/20頁(yè) |
| 文件大小： | 334K |
| 代理商： | X9258TS24Z |
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8
FN8168.4
August 30, 2006
Figure 7. Acknowledge Response from Receiver
Figure 8. Detailed Potentiometer Block Diagram Detailed Operation
All DCP potentiometers share the serial interface and
share a common architecture. Each potentiometer has
a Wiper Counter Register and four Data Registers. A
detailed discussion of the register organization and
array operation follows.
Wiper Counter Register
The X9258 contains four Wiper Counter Registers,
one for each DCP potentiometer. The Wiper Counter
Register can be envisioned as a 8-bit parallel and
serial load counter with its outputs decoded to select
one of 256 switches along its resistor array. The
contents of the WCR can be altered in four ways: it
may be written directly by the host via the Write Wiper
Counter Register instruction (serial load); it may be
written indirectly by transferring the contents of one of
four associated Data Registers via the XFR Data
Register instruction (parallel load); it can be modified
one step at a time by the Increment/Decrement
instruction. Finally, it is loaded with the contents of its
data register zero (R0) upon power-up.
SCL from
Master
Data Output
from Transmitter
1
8
9
START
Acknowledge
Data Output
from Receiver
Serial Data Path
From Interface
Circuitry
Register 0
Register 1
Register 2
Register 3
Serial
BUS
Input
Parallel
BUS
Input
Wiper
Counter
Register
(WCR)
INC/DEC
Logic
UP/DN
CLK
Modified SCL
UP/DN
V
H
/R
H
V
L
/R
L
V
W
/R
W
If WCR = 00[H] then V
W
/R
W
= V
L
/R
L
If WCR = FF[H] then V
W
/R
W
= V
H
/R
H
8
8
C
o
u
n
t
e
r
D
e
c
o
d
e
X9258
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PDF描述 |
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