參數(shù)資料
型號： WARP20
廠商： 意法半導(dǎo)體
英文描述： 8-BIT FUZZY CO-PROCESSOR
中文描述： 8位模糊協(xié)處理器
文件頁數(shù)： 22/28頁
文件大?。?/td> 275K
代理商： WARP20
ON-LINE MASTER PHASE TIMING
OC0-OC1
OFL
DS
READY
BUSY
RD
I0-I7
INP 0
INP 1
INPN
O0-O10
O11
OUT 0
OUT 1
OUT N
ADDR0
ADDR 1
ADDRN
WAIT
OUT N-1
ADDRN-1
T
4
T
5
T
6
T
7
T
8
T
3
T
2
T
3
T
1
T
9
T
10
T
10
T
11
Symbol
Mode
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
On-Line
Master
Parameter
OFL Low
to first RD High
RD High
to READY High
OFL/BUSY Low
to O11 Pulse
RD High
to next RD High
READY High
to BUSY High
BUSY High
to first Output Ready
DS High
to next DS High
WAIT Low
to next Output Valid
Elaboration
Time
Min
Typ
Max
Unit
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
Clock
Pulses
T
1
3
T
2
2
T
3
10
T
4
10
T
5
1
T
6(1)
64
T
7(1)
64
T
8
32
T
9
see fig.6
T
10
DS Pulse Width
5
T
11
LAST DS Pulse Width
1
Table 13. On-Line Master Timing Parameters
Note 1.It depends on the number of rules related to thecurrent output variable.Each output variableneeds at least two
rules and each rulerequires 32 clock pulses.
22/28
W.A.R.P.2.0
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