參數(shù)資料
型號： W78E858
廠商： WINBOND ELECTRONICS CORP
元件分類： 微控制器/微處理器
英文描述： 8 BIT MICROCONTROLLER
中文描述： 8-BIT, FLASH, 40 MHz, MICROCONTROLLER, PDIP40
封裝： DIP-40
文件頁數(shù)： 26/33頁
文件大?。?/td> 1186K
代理商： W78E858
W78E858
- 26 -
7.3.3 Data Read Cycle
PARAMETER
SYMBOL
T
dar
MIN.
3 T
CP
-
TYP.
-
MAX.
3 T
CP+
UNIT
nS
NOTES
1, 2
ALE Low to
RD
Low
RD
Low to Data Valid
T
dda
-
-
4 T
CP
nS
1
Data Hold from
RD
High
T
ddh
0
-
2 T
CP
nS
Data Float from
RD
High
T
ddz
0
-
2 T
CP
nS
RD
Pulse Width
T
drd
6 T
CP
-
6 T
CP
-
nS
2
Notes:
1. Data memory access time is 8 T
CP
.
2. "
" (due to buffer driving delay and wire loading) is 20 nS.
7.3.4 Data Write Cycle
PARAMETER
SYMBOL
T
DAW
MIN.
3 T
CP
-
1 T
CP
-
1 T
CP
-
6 T
CP
-
TYP.
-
MAX.
3 T
CP
+
UNIT
nS
ALE Low to
WR
Low
Data Valid to
WR
Low
T
DAD
-
-
nS
Data Hold from
WR
High
T
DWD
-
-
nS
WR
Pulse Width
T
DWR
6 T
CP
-
nS
Note:
"
" (due to buffer driving delay and wire loading) is 20 nS.
7.3.5 Port Access Cycle
PARAMETER
SYMBOL
T
PDS
T
PDH
T
PDA
MIN.
1 T
CP
0
1 T
CP
TYP.
-
-
-
MAX.
-
-
-
UNIT
nS
nS
nS
Port Input Setup to ALE Low
Port Input Hold from ALE Low
Port Output to ALE
Note:
Ports are read during S5P2, and output data becomes available at the end of S6P2. The timing data are referenced to
ALE, since it provides a convenient reference.
7.3.6 Flash Mode Timing
PARAMETER
SYMBOL
T
RV
T
EFRL
T
PPH
T
PPL
T
EPL
T
RPL
T
APF
T
DR
MIN.
9
9
18
40
25
1.35
45
81
TYP.
10
10
20
50
30
1.5
50
90
MAX.
11
11
22
60
50
1.65
55
99
UNIT
μ
S
μ
S
μ
S
μ
S
mS
μ
S
nS
nS
NOTES
-
-
-
-
-
-
-
-
Reset Valid
Enter Flash Mode Reset Low
Program Pulse High
Program Pulse Low
Erase Pulse Low
Read Pulse Low
Address PreFix
Data Remain
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