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參數(shù)資料
| 型號： | W681513SG |
| 廠商： | WINBOND ELECTRONICS CORP |
| 元件分類： | 編解碼器 |
| 英文描述： | A/MU-LAW, PCM CODEC, PDSO20 |
| 封裝： | 0.300 INCH, ROHS COMPLIANT, SOP-20 |
| 文件頁數(shù)： | 2/35頁 |
| 文件大?。?/td> | 347K |
| 代理商： | W681513SG |
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W681513
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can be achieved. If the transmit power amplifier is not in use, it can be powered down by connecting
PAI to VDD.
7.3. POWER MANAGEMENT
7.3.1. Analog and Digital Supply
The power supply for the analog and digital parts of the W681513 must be 5V +/- 10%. This supply
voltage is connected to the VDD pin. The VDD pin needs to be decoupled to ground through a 0.1 μF
ceramic capacitor.
7.3.2. Analog Ground Reference Voltage Output
The analog ground reference voltage is available for external reference at the VAG pin. This voltage
needs to be decoupled to VSS through a 0.01 μF ceramic capacitor.
7.4. PCM INTERFACE
The PCM interface is controlled by pins BCLKR, FSR, BCLKT & FST. The input data is received
through the PCMR pin and the output data is transmitted through the PCMT pin. The modes of
operation of the interface are shown in Table 7.3.
BCLKR
FSR
Interface Mode
2.000 MHz
8 kHz
Long or Short Frame Sync
VSS
ISDN GCI with active channel B1
VSS
VDD
ISDN GCI with active channel B2
VDD
VSS
ISDN IDL with active channel B1
VDD
ISDN IDL with active channel B2
Table 7.3 PCM Interface mode selections
7.4.1. Long Frame Sync
The Long Frame Sync or Short Frame Sync interface mode can be selected by connecting the
BCLKR or BCLKT pin to a 2.000 MHz clock and connecting the FSR or FST pin to the 8 kHz frame
sync. The device synchronizes the data word for the PCM interface and the CODEC sample rate on
the positive edge of the Frame Sync signal. It recognizes a Long Frame Sync when the FST pin is
相關PDF資料 |
PDF描述 |
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| W72M64VB90BC | SPECIALTY MEMORY CIRCUIT, PBGA159 |
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| W73B586A-11L | 32K X 18 CACHE SRAM, 11 ns, PQCC52 |
| W764M32V120SBM | 64M X 32 FLASH 3V PROM, 120 ns, PBGA107 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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