參數(shù)資料
型號(hào)： VSP2212Y
英文描述： CCD SIGNAL PROCESSOR For Digital Cameras
中文描述： CCD信號(hào)處理器的數(shù)碼相機(jī)
文件頁數(shù)： 6/11頁
文件大?。?/td> 125K
代理商： VSP2212Y
6
VSP2212
SERIAL INTERFACE TIMING SPECIFICATIONS
SYMBOL
PARAMETER
MIN
TYP
MAX
UNITS
t
CKP
t
CKH
t
CKL
t
DS
t
DH
t
XS
t
XH
Clock Period
100
ns
Clock HIGH Pulse Width
40
ns
Clcok LOW Pulse Width
40
ns
Data Setup Time
30
ns
Data Hold TIme
30
ns
SLOAD to SCLK Setup Time
30
ns
SCLK to SLOAD Setup Time
(1)
30
ns
NOTES: (1) It is effective for the data shift operation at the rising edge of SCLK during SLOAD is LOW period.
And Input 2 bytes data are loaded to the parallel latch in the VSP2212 at the rising edge of SLOAD. (2) When
the input serial data is longer than 2 bytes (16 bits), the last 2 bytes become effective and the former bits are
discarded.
SLOAD
SCLK
(1)
MSB
LSB
SDATA
t
CKP
t
XS
t
CKH
t
DH
t
DS
2 Bytes
(2)
t
CKL
t
XH
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PDF描述
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參數(shù)描述
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