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參數(shù)資料
| 型號： | UT8Q1024K8-UPA |
| 廠商： | Aeroflex Inc. |
| 英文描述： | high-performance 1M byte (8Mbit) CMOS static RAM |
| 中文描述： | 高性能1M字節(jié)（8Mbit）的CMOS靜態(tài)RAM |
| 文件頁數(shù)： | 9/15頁 |
| 文件大?。?/td> | 238K |
| 代理商： | UT8Q1024K8-UPA |
9
Assumptions:
1. G < V
IL
(max). If G > V
IH
(min) then Qn(8:0) will be
in three-state for the entire cycle.
2. G high for t
AVAV
cycle.
Wn
t
AVWL
Figure 5a. SRAM Write Cycle 1: Write Enable - Controlled Access
A(18:0)
Q(7:0)
En
t
AVAV
2
D(7:0)
APPLIED DATA
t
DVWH
t
WHDX
t
ETWH
t
WLWH
t
WHAX
t
WHQX
t
WLQZ
t
AVWH
t
WHWL
t
EFDX
Assumptions & Notes:
1. G < V
IL
(max). If G > V
IH
(min) then Q(7:0) will be in three-state for the entire cycle.
2. Either En scenario above can occur.
3. G high for t
AVAV
cycle.
Figure 5b. SRAM Write Cycle 2: Chip Enable - Controlled Access
A(18:0)
Wn
En
D(7:0)
APPLIED DATA
En
Q(7:0)
t
WLQZ
t
ETEF
t
WLEF
t
DVEF
t
AVAV
3
t
AVET
t
AVET
t
ETEF
t
EFAX
t
EFAX
or
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PDF描述 |
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參數(shù)描述 |
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