參數(shù)資料
型號: UPSD3433E
廠商: 意法半導(dǎo)體
英文描述: Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
中文描述: Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器
文件頁數(shù): 205/264頁
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代理商: UPSD3433E
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uPSD34xx - PSD MODULE
PLD I/O Mode.
Pins on Ports A, B, C, and D can
serve as inputs to either the DPLD or the GPLD.
Inputs to these PLDs from Ports A, B, and C are
routed through IMCs before reaching the PLD in-
put bus. Inputs to the PLDs from Port D do not
pass through IMCs, but route directly to the PLD
input bus.
Pins on Ports A, B, and C can serve as outputs
from GPLD OMCs, and Port D pins can be outputs
from the DPLD (external chip-selects) which do
not consume OMCs.
Whenever a pin is specified to be a PLD output, it
cannot be used for MCU I/O mode, or other pin
modes. If a pin is specified to be a PLD input, it is
still possible to read the pin using MCU I/O input
mode with the csiop register Data In. Also, the
csiop Direction register can still affect a pin which
is used for a PLD input. The csiop Data Out regis-
ter has no effect on a PLD output pin.
Each pin on Ports A, B, C, and D have a tri-state
buffer at the final output stage. The Output Enable
signal for this buffer is driven by the logical OR of
two signals. One signal is an Output Enable signal
generated by the AND-OR array (from an .oe
equation specified in PSDsoft), and the other sig-
nal is the output of the csiop Direction register.
This logic is shown in
Figure 80., page 200
. At
power-on, all port pins default to high-impedance
input (Direction registers default to 00h). However,
if an equation is written for the Output Enable that
is active at power-on, then the pin will behave as
an output.
PLD I/O equations are specified in PSDsoft Ex-
press and programmed into the uPSD using
JTAG. Figure
81
shows a very simple combinato-
rial logic example which is implemented on pins of
Port B.
To give a general idea of how PLD logic is imple-
mented
using
PSDsoft
82., page 206
illustrates the pin declaration win-
dow of PSDsoft Express, showing the PLD output
at pin PB0 declared as “Combinatorial” in the “PLD
Output” section, and a signal name, “pld_out”, is
specified. The other three signals on pins PB1,
PB2, and PB3 would be declared as “Logic or Ad-
dress” in the “PLD Input” section, and given signal
names.
In the “Design Assistant” window of PSDsoft Ex-
press shown in
Figure 83., page 207
, the user
simply enters the logic equation for the signal
“pld_out” as shown. The user can either type in the
logic statements or enter them using a point-and-
click method, selecting various signal names and
logic operators available in the window.
After PSDsoft Express has accepted and realized
the logic from the equations, it synthesizes the log-
ic statement:
pld_out = ( pld_in_1 # pld_in_2 ) & !pld_in_3;
Express,
Figure
to be programmed into the GPLD. See the PSD-
soft User’s Manual for all the steps.
Note:
If a particular OMC output is specified as an
internal node and not specified as a port pin output
in PSDsoft Express, then the port pin that is asso-
ciated with that OMC can be used for other I/O
functions.
Figure 81. Simple PLD Logic Example
PLDIN 1
PLDIN 2
PLDIN 3
PLD OUT
PB0
PB3
PB2
PB1
AI09178
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PDF描述
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