參數(shù)資料
型號： UPSD3424EV-40T6T
廠商： 意法半導(dǎo)體
英文描述： Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
中文描述： Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器
文件頁數(shù)： 225/264頁
文件大?。?/td> 4320K
代理商： UPSD3424EV-40T6T
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uPSD34xx - PSD MODULE
In MCU I/O mode, Latched Address Out mode,
and Peripheral I/O mode, the pins of Ports A, B, C,
and D become standard CMOS inputs during a re-
set condition. If no external devices are driving
these pins during reset, then these inputs may
float and draw excessive current. If low power con-
sumption is critical during reset, then these floating
inputs should be pulled up externally to V
DD
with a
weak (100K
minimum) resistor.
In PLD I/O mode, pins of Ports A, B, C, and D may
also float during reset if no external device is driv-
ing them, and if there is no equation specified for
the DPLD or GPLD to make them an output. In this
case, a weak external pull-up resistor (100K
min-
imum) should be used on floating pins to avoid ex-
cessive current draw.
The pins on Ports 1, 3, and 4 of the 8032 MCU
module do have weak internal pull-ups and the in-
puts will not float, so no external pull-ups are need-
ed.
Table 148. Function Status During Power-Up Reset, Warm Reset, Power-down Mode
Note: 1. VM register Bit 7 (PIO_EN) and Bit 0 (SRAM in 8032 program space) are cleared to zero at power-up and warm reset conditions.
Port Configuration
Power-Up Reset
Warm Reset
APD Power-down Mode
MCU I/O
Pins are in input mode
Pins are in input mode
Pin logic state is
unchanged
PLD I/O
Pin logic is valid after
internal PSD Module
configuration bits are
loaded. Happens long
before RST is de-asserted
Pin logic is valid and is
determined by PLD logic
equations
Pin logic depends on inputs
to PLD (8032 addresses
are blocked from reaching
PLD inputs during power-
down mode)
Latched Address Out Mode
Pins are High Impedance
Pins are High Impedance
Pins logic state not defined
since 8032 address signals
are blocked
Peripheral I/O Mode
Pins are High Impedance
Pins are High Impedance
Pins are High Impedance
JTAG ISP and Debug
JTAG channel is active and
available
JTAG channel is active and
available
JTAG channel is active and
available
Register
Power-Up Reset
Warm Reset
APD Power-down Mode
PMMR0 and PMMR2
Cleared to 00h
Unchanged
Unchanged
Output of OMC Flip-flops
Cleared to ’0’
Depends on .re and .pr
equations
Depends on .re and .pr
equations
VM Register
(1)
Initialized with value that
was specified in PSDsoft
Initialized with value that
was specified in PSDsoft
Unchanged
All other csiop registers
Cleared to 00h
Cleared to 00h
Unchanged
相關(guān)PDF資料
PDF描述
UPSD3424EV-40U6T Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic
UPZW6271MHD ALUMINUM ELECTROLYTIC CAPACITORS
UPZW6271MPD ALUMINUM ELECTROLYTIC CAPACITORS
UPZW6470MPD ALUMINUM ELECTROLYTIC CAPACITORS
UPZW6560MPD ALUMINUM ELECTROLYTIC CAPACITORS
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參數(shù)描述
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UPSD3433EB40T6 功能描述:8位微控制器 -MCU Turbo 8032 MCU w/USB & Programmable Logic RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
UPSD3433EB40U6 功能描述:8位微控制器 -MCU uPSD34x Turbo Plus Fast Turbo 8032 MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT
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