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參數(shù)資料
| 型號： | UPSD3424E-40U6T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 63/264頁 |
| 文件大?。?/td> | 4320K |
| 代理商： | UPSD3424E-40U6T |
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uPSD34xx - MCU BUS INTERFACE
MCU BUS INTERFACE
The MCU Module has a programmable bus inter-
face which is a modified 8032 bus with 16 multi-
plexed address and data lines. The bus supports
four types of data transfer (16- or 8-bit), each
transfer is to/from a memory location external to
the MCU Module:
–
Code Fetch cycle using the PSEN signal: fetch
a 16-bit code word for filling the pre-fetch
queue. The CPU fetches a code byte from the
PFQ for execution;
–
Code Read cycle using PSEN: read a 16-bit
code word using the MOVC (Move Constant)
instruction. The code word is routed directly to
the CPU and by-pass the PFQ;
–
XDATA Read cycle using the RD signal: read
a data byte using the MOVX (Move eXternal)
instruction; and
–
XDATA Write cycle using the WR signal: write
a data byte using the MOVX instruction
PSEN Bus Cycles
In a PSEN bus cycle, the MCU module fetches the
instruction from the 16-bit program memory in the
PSD module. The multiplexed address/data bus
AD[15:0] is connected to the PSD module for 16-
bit data transfer. The uPSD34xx does not support
external PSEN cycles and cannot fetch instruction
from other external program memory devices.
READ or WRITE Bus Cycles
In an XDATA READ or WRITE bus cycle, the
MCU’s multiplexed AD[15:0] bus is connected to
the PSD module, but only the lower bytes AD[7:0]
are used for the 8-bit data transfer. The AD[7:0]
lines are also connected to pins in the 80-pin pack-
age for accessing external devices. If the high ad-
dress byte A[15:8] is needed for external devices,
Port B in the PSD Module can be configured to
provide the latched A[15:8] address outputs.
Connecting External Devices to the MCU Bus
The uPSD34xx supports 8-bit only external I/O or
Data memory devices. The READ and WRITE
data transfer is carried out on the AD[7:0] bus
which is available in the 80-pin package. The ad-
dress lines can be brought out to the external de-
vices in one of three ways:
1.
Configure Ports B and A of the PSD Module in
Address Output mode, as shown in Figure
20
;
2.
Use Port B together with an external latch, as
shown in
Figure 21., page 64
. The external
latch latches the low address byte from the
AD[7:0] bus with the ALE signal.This
configuration is for design where Port A is
needed for CPLD functions; and
3.
Configure the microcell in the CPLD to output
any address line to any of the CPLD output
pins. This is the most flexible implementation
but requires the use of CPLD resources.
Ports A and B in the PSD Module can be config-
ured in the PSDsoft to provide latched MCU ad-
dress A[7:0] and A[15:8] (see
PSD Module
Detailed Operation, page 178
for details on how to
enable Address Output mode). The latched ad-
dress outputs on the ports are pin configurable.
For example, Port B pins PB[2:0] can be enabled
to provide A[10:8] and the remaining pins can be
configured for other functions such as generating
chip selects to the external devices.
Figure 20. Connecting External Devices using Ports A and B for Address AD[15:0]
uPSD34xx
PSD
Module
External
8-bit
Device
MCU
Module
AI10434
AD[7:0]
D[7:0]
A8-15
A0-7
Port A
CS
Port B
AD[15:8]
PSEN
ALE
RD or WR
RD or WR
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PDF描述 |
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