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參數(shù)資料
| 型號： | UPSD3423E-40U6T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Turbo Plus Series Fast Turbo 8032 MCU with USB and Programmable Logic |
| 中文描述： | Turbo Plus系列高速渦輪8032 USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 148/264頁 |
| 文件大小： | 4320K |
| 代理商： | UPSD3423E-40U6T |
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uPSD34xx - USB INTERFACE
148/264
–
USB FIFO Base Address High and Low
Registers (UBASEH and UBASEL)
All 10 Endpoint FIFOs share the same 64-byte
address range. The 16-bit base address for
the FIFOs is specified using the USB Base
Address registers (see
Table 85.
and
Table
86.
). The USB Endpoint Select Register (see
Table 82., page 145
) selects the direction and
the Endpoint for the FIFO that is accessed
when addressing the 64-bytes of XDATA
space starting with the base address specified
in the Base Address Registers. The Base
Address is a 64-byte segment where the lower
6 bits of the base register are hardwired to '0.'
Important Note:
The USB FIFO Base
Address must be set to an open 64-byte
segment in the XDATA space. Care should be
taken to ensure that there is no overlap of
addresses between the USB FIFOs and the
flash memory, SRAM, csiop registers, and
anything else accessed in the XDATA space.
While the logic in the PSD module handles
overlap of flash memory, SRAM, and the csiop
registers with a fixed priority (see
PSD Module
Functional Description, page 165
), this is not
the case with the USB FIFOs. Unpredictable
results as well as potential damage to the
device may occur if there is an overlap of
addresses.
Table 85. USB FIFO Base Address High Register (UBASEH 0F3h, Reset Value 00h)
Table 86. USB FIFO Base Address Low Register (UBASEL 0F4h, Reset Value 00h)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
BASEADDR[15:8]
Details
Bit
Symbol
R/W
Definition
7:0
BASEADDR
[15:8]
R/W
The upper 8 bits of the 16-bit base address for USB FIFOs to be mapped
in XDATA space
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
BASEADDR[7:6]
0
0
0
0
0
0
Details
Bit
Symbol
R/W
Definition
7:6
BASEADDR
[7:6]
R/W
Bits 7 and 6 of the 16-bit base address for the USB FIFOs to be mapped
in XDATA space
5:0
BASEADDR
[5:0]
R
Hardwired '0'
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PDF描述 |
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