參數(shù)資料
型號: uPSD3412C-40U6T
廠商: 意法半導體
英文描述: 320 x 240 pixel format, CFL backlight available with power harness
中文描述: 閃存可編程系統(tǒng)設備與8032微控制器核心和16Kbit SRAM的
文件頁數(shù): 41/152頁
文件大小: 1558K
代理商: UPSD3412C-40U6T
41/152
UPSD3212C, UPSD3212CV
Table 20. Description of the IE Bits.
Table 21. Description of the IEA Bits
Table 22. Description of the IP Bits
Bit
Symbol
Function
7
EA
Disable all interrupts:
0: no interrupt with be acknowledged
1: each interrupt source is individually enabled or disabled by setting or clearing its
enable bit
6
Reserved
5
ET2
Enable Timer 2 Interrupt
4
ES
Enable USART Interrupt
3
ET1
Enable Timer 1 Interrupt
2
EX1
Enable External Interrupt (Int1)
1
ET0
Enable Timer 0 Interrupt
0
EX0
Enable External Interrupt (Int0)
Bit
Symbol
Function
7
Not used
6
Not used
5
Not used
4
ES2
Enable 2nd USART Interrupt
3
Not used
2
Not used
1
EI2C
Enable I2C Interrupt
0
Not used
Bit
Symbol
Function
7
Reserved
6
Reserved
5
PT2
Timer 2 Interrupt priority level
4
PS
USART Interrupt priority level
3
PT1
Timer 1 Interrupt priority level
2
PX1
External Interrupt (Int1) priority level
1
PT0
Timer 0 Interrupt priority level
0
PX0
External Interrupt (Int0) priority level
相關PDF資料
PDF描述
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參數(shù)描述
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