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參數(shù)資料
| 型號： | uPSD3234AV-40U1T |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | Flash Programmable System Devices with 8032 Microcontroller Core |
| 中文描述： | 閃存可編程系統(tǒng)設(shè)備與8032微控制器內(nèi)核 |
| 文件頁數(shù)： | 45/170頁 |
| 文件大?。?/td> | 2717K |
| 代理商： | UPSD3234AV-40U1T |
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uPSD3234A, uPSD3234BV, uPSD3233B, uPSD3233BV
OSCILLATOR
The oscillator circuit of the uPSD323X Devices is
a single stage inverting amplifier in a Pierce oscil-
lator configuration. The circuitry between XTAL1
and XTAL2 is basically an inverter biased to the
transfer point. Either a crystal or ceramic resonator
can be used as the feedback element to complete
the oscillator circuit. Both are operated in parallel
resonance.
XTAL1 is the high gain amplifier input, and XTAL2
is the output. To drive the uPSD323X Devices ex-
ternally, XTAL1 is driven from an external source
and XTAL2 left open-circuit.
Figure 19. Oscillator
SUPERVISORY
There are four ways to invoke a reset and initialize
the uPSD323X Devices.
Via the external RESET pin
Via the internal LVR Block.
Via USB bus reset signaling.
Via Watch Dog timer
■
■
■
■
The RESET mechanism is illustrated in Figure
20
.
Each RESET source will cause an internal reset
signal active. The CPU responds by executing an
internal reset and puts the internal registers in a
defined state. This internal reset is also routed as
an active low reset input to the PSD Module.
Figure 20. RESET Configuration
AI06620
XTAL1
XTAL2
8 to 40 MHz
XTAL1
XTAL2
External Clock
AI06621
Reset
CPU
&
PERI.
Noise
Cancel
LVR
S
Q
R
CPU
Clock
Sync
10ms
Timer
USB Reset
RSTE
WDT
PSD_RST
“
Active Low
10ms at 40Mhz
50ms at 8Mhz
相關(guān)PDF資料 |
PDF描述 |
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