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參數(shù)資料
| 型號： | UPSD3212AV-40U6T |
| 廠商： | 意法半導體 |
| 英文描述： | Flash Programmable System Devices with 8032 MCU with USB and Programmable Logic |
| 中文描述： | 閃存可編程系統(tǒng)設備與8032具有USB和可編程邏輯控制器 |
| 文件頁數(shù)： | 141/163頁 |
| 文件大?。?/td> | 2844K |
| 代理商： | UPSD3212AV-40U6T |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁當前第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁
141/163
uPSD3212A, uPSD3212C, uPSD3212CV
Table 117. External Program Memory AC Characteristics (with the 3V MCU Module)
Note: 1. Conditions (in addition to those in
Table 110., page 133
, V
CC
= 3.0 to 3.6V): V
SS
= 0V; C
L
for Port 0, ALE and PSEN output is 100pF,
for 5V devices, and 50pF for 3V devices; C
L
for other outputs is 80pF, for 5V devices, and 50pF for 3V devices)
2. Interfacing the uPSD321x Devices to devices with float times up to 35ns is permissible. This limited bus contention does not cause
any damage to Port 0 drivers.
Symbol
Parameter
(1)
24MHz Oscillator
Variable Oscillator
1/t
CLCL
= 8 to 24MHz
Unit
Min
Max
Min
Max
t
LHLL
ALE pulse width
43
2t
CLCL
– 40
ns
t
AVLL
Address set up to ALE
17
t
CLCL
– 25
ns
t
LLAX
Address hold after ALE
17
t
CLCL
– 25
ns
t
LLIV
ALE Low to valid instruction in
80
4t
CLCL
– 87
ns
t
LLPL
ALE to PSEN
22
t
CLCL
– 20
ns
t
PLPH
PSEN pulse width
95
3t
CLCL
– 30
ns
t
PLIV
PSEN to valid instruction in
60
3t
CLCL
– 65
ns
t
PXIX
Input instruction hold after PSEN
0
0
ns
t
PXIZ(2)
Input instruction float after PSEN
32
t
CLCL
– 10
ns
t
PXAV(2)
Address valid after PSEN
37
t
CLCL
– 5
ns
t
AVIV
Address to valid instruction in
148
5t
CLCL
– 60
ns
t
AZPL
Address float to PSEN
–10
–10
ns
相關PDF資料 |
PDF描述 |
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