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參數(shù)資料
| 型號： | UPD78044A |
| 廠商： | NEC Corp. |
| 元件分類： | DC/DC變換器 |
| 英文描述： | 1 watt dc-dc converters |
| 中文描述： | 1瓦的DC - DC轉換器 |
| 文件頁數(shù)： | 39/62頁 |
| 文件大小： | 576K |
| 代理商： | UPD78044A |
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μ
PD78001B(A), 78002B(A)
39
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
t
KCY3
V
DD
= 4.5 to 6.0 V
800
ns
3200
ns
SCK high/low-level width
t
KH3
V
DD
= 4.5 to 6.0 V
t
KCY3
/2-50
ns
t
KL3
t
KCY3
/2-150
ns
SB0, SB1 setup time
t
SIK3
V
DD
= 4.5 to 6.0 V
100
ns
(to SCK
↑
)
300
ns
SB0, SB1 hold time
t
KSI3
t
KCY3
/2
ns
from SCK
↓
SB0, SB1 output delay time
t
KSO3
R = 1 k
,
V
DD
= 4.5 to 6.0 V
0
250
ns
(from SCK
↑
)
C = 100 pF
*
0
1000
ns
SB0, SB1
↓
from SCK
↑
t
KSB
t
KCY3
ns
SCK
↓
from SB0, SB1
↓
t
SBK
t
KCY3
ns
SB0, SB1 high-level width
t
SBH
t
KCY3
ns
SB0, SB1 low-level width
t
SBL
t
KCY3
ns
(c) SBI mode (SCK... Internal clock output)
*
R and C are the load resistors and load capacitance of the SB0 and SB1 output line.
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCK cycle time
t
KCY4
V
DD
= 4.5 to 6.0 V
800
ns
3200
ns
SCK high/low-level width
t
KH4
V
DD
= 4.5 to 6.0 V
400
ns
t
KL4
1600
ns
SB0, SB1 setup time
t
SIK4
V
DD
= 4.5 to 6.0 V
100
ns
(to SCK
↑
)
300
ns
SB0, SB1 hold time
t
KSI4
t
KCY4/
2
ns
(from SCK
↓)
SB0, SB1 output delay time
t
KSO4
R = 1 k
,
V
DD
= 4.5 to 6.0 V
0
300
ns
from SCK
↑
C = 100 pF
*
0
1000
ns
SB0, SB1
↓
from SCK
↑
t
KSB
t
KCY4
ns
SCK
↓
from SB0, SB1
↓
t
SBK
t
KCY4
ns
SB0, SB1 high-level width
t
SBH
t
KCY4
ns
SB0, SB1 low-level width
t
SBL
t
KCY4
ns
SCK rise, fall time
When external device expansion
function is used
160
ns
When external device expansion
function is not used
1000
ns
(d) SBI mode (SCK... External clock input)
*
R and C are the load resistors and load capacitance of the SB0 and SB1 output line.
t
R4
t
F4
相關PDF資料 |
PDF描述 |
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