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參數(shù)資料
| 型號(hào)： | UPD78044A |
| 廠商： | NEC Corp. |
| 元件分類： | DC/DC變換器 |
| 英文描述： | 1 watt dc-dc converters |
| 中文描述： | 1瓦的DC - DC轉(zhuǎn)換器 |
| 文件頁(yè)數(shù)： | 36/62頁(yè) |
| 文件大小： | 576K |
| 代理商： | UPD78044A |
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36
μ
PD78001B(A), 78002B(A)
AC Characteristics
(T
A
= –40 to +85
°
C, V
DD
= 2.7 to 6.0 V)
(1) Basic Operation
μ
PD78001B(A), 78002B(A)
T
CY
vs V
DD
(At main system clock operation)
μ
PD78P014 (Reference)
T
CY
vs V
DD
(At main system clock operation)
60
10
2.0
1.0
0.5
0.4
0
1
2
3
4
5
6
Supply Voltage V
DD
[V]
Operation Guaranteed
Range
60
10
2.0
1.0
0.5
0.4
0
1
2
3
4
5
6
Supply Voltage V
DD
[V]
Operation Guaranteed
Range
Caution
The operation guaranteed range of the
μ
PD78001B(A), and 78002B(A) differs from that of the
μ
PD78P014.
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
Cycle time
Operating on main
V
DD
= 4.5 to 6.0 V
0.4
64
μ
s
(Min. instruction
T
CY
system clock
0.96
64
μ
s
execution time)
Operationg on subsystem clock
40
122
125
μ
s
TI input
f
TI
V
DD
= 4.5 to 6.0 V
0
4
MHz
frequency
0
275
kHz
TI input high/
t
TIH
V
DD
= 4.5 to 6.0 V
100
ns
low-level width
t
TIL
1.8
μ
s
Interrupt input
t
INTH
INTP0
8/f
sam
*
μ
s
high/low-level
t
INTL
INTP1 to INTP3
10
μ
s
width
KR0 to KR7
10
μ
s
RESET low
t
RSL
10
μ
s
level width
*
In combination with bits 0 (SCS0) and 1 (SCS1) of sampling clock select register, selection of fsam is possible between fX/2
N+1
,
f
X
/64 and f
x
/128 (when N = 0 to 4).
C
C
μ
s
C
C
μ
s
Remark
indicates T
A
=–40 to +40
°
C
indicates T
A
=–40 to +85
°
C
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