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參數資料
| 型號： | UPD72042 |
| 廠商： | NEC Corp. |
| 英文描述： | LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL |
| 中文描述： | LSI器件間設備BusTM（IEBusTM）協議控制 |
| 文件頁數： | 43/92頁 |
| 文件大?。?/td> | 373K |
| 代理商： | UPD72042 |
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μ
PD72042
43
Data Sheet S14870EJ1V0DS00
LOR1
LOR2
Address
: 0100B (4H) (LOR1)
0101B (5H) (LOR2)
: Read
Read/write
When reset : 0
×
H (LOR2)
Lock register
LOR1 is undefined.
The LOR1 and LOR2 registers are used to hold a lock state.
LOR1 and LOR2 set a lock state and lock address after the lock state setting command is set in the CMR register
(LOCK = 1), then executed.
[Lock state]
0000: Not locked
0001: Locked
Remark
When 0000 (not locked) is set in the lock state bits, any lock address value is ignored.
b7
Lock state
b4
b3
b0
Lock address (high-order 4 bits)
LOR2
b7
b0
Lock address (low-order 8 bits)
LOR1
相關PDF資料 |
PDF描述 |
|---|---|
| UPD72042GT | LSI DEVICES FOR Inter Equipment BusTM (IEBusTM) PROTOCOL CONTROL |
| uPD72107GC-3B9 | LAP-B CONTROLLER(Link Access Procedure Balanced mode) |
| UPD72107 | LAP-B CONTROLLER(Link Access Procedure Balanced mode) |
| uPD72107CW | LAP-B CONTROLLER(Link Access Procedure Balanced mode) |
| uPD72107L | LAP-B CONTROLLER(Link Access Procedure Balanced mode) |
相關代理商/技術參數 |
參數描述 |
|---|---|
| UPD72042BGT-A | 制造商:Renesas Electronics 功能描述:LSI Device 16-Pin SOP 制造商:Renesas Electronics 功能描述:LSI Device 16-Pin SOP Cut Tape |
| UPD72042GT(A) | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD720902AF5-667-JF2-E3-A | 功能描述:IC ADVANCED MEMORY BUFFER D1 RoHS:是 類別:集成電路 (IC) >> 接口 - 專用 系列:* 標準包裝:90 系列:- 應用:PCI 至 PCI 橋 接口:PCI 電源電壓:3 V ~ 3.6 V 封裝/外殼:257-LFBGA 供應商設備封裝:257-BGA MICROSTAR（16x16） 包裝:托盤 安裝類型:表面貼裝 產品目錄頁面:882 (CN2011-ZH PDF) 其它名稱:296-19316 |
| UPD72255YF1-GA5-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD7225G | 制造商:Panasonic Industrial Company 功能描述:IC |
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